參數(shù)資料
型號(hào)： ICS9FG108YFLF-T
英文描述： Programmable FTG for Differential P4 CPU, PCI-Express & SATA Clocks
中文描述： 可編程FTG微分小的CPU和PCI - Express
文件頁(yè)數(shù)： 12/13頁(yè)
文件大?。?/td> 145K
代理商： ICS9FG108YFLF-T
12
Integrated
Circuit
Systems, Inc.
ICS9FG108
Advance Information
0823—04/02/04
Ordering Information
ICS9FG108
y
FLF-T
Example:
AREA
INDEX
1 2
N
D
h x 45°
E1
E
α
PLANE
SEATING
A1
A
e
- C -
b
.10 (.004) C
c
L
MIN
2.41
0.20
0.20
0.13
SEE VARIATIONS
MAX
2.80
0.40
0.34
0.25
MIN
.095
.008
.008
.005
SEE VARIATIONS
MAX
.110
.016
.0135
.010
A
A1
b
c
D
E
E1
e
h
L
N
α
10.03
7.40
10.68
7.60
.395
.291
.420
.299
0.38
0.50
SEE VARIATIONS
0.64
1.02
.015
.020
SEE VARIATIONS
.025
.040
0°
8°
0°
8°
MIN
15.75
MAX
16.00
MIN
.620
MAX
.630
48
10-0034
SYMBOL
In Millimeters
COMMON DIMENSIONS
In Inches
COMMON DIMENSIONS
0.635 BASIC
0.025 BASIC
Reference Doc.: JEDEC Publication 95, MO-118
VARIATIONS
D mm.
N
D (inch)
Designation for tape and reel packaging
Lead Free (if required)
Package Type
F = SSOP
Revision Designator
(will not correlate with datasheet revision)
Device Type (consists of 3 or 4 digit numbers)
Prefix
ICS, AV = Standard Device
ICS XXXX
y
F - LF T
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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