參數(shù)資料
型號： ICS9LPR501yGLFT
英文描述： 64-pin CK505 w/Fully Integrated Voltage Regulator
中文描述： 64引腳CK505瓦特/全集成穩(wěn)壓器
文件頁數(shù)： 16/22頁
文件大?。?/td> 250K
代理商： ICS9LPR501YGLFT
16
Integrated
Circuit
Systems, Inc.
ICS9LPR501
1118E—08/08/07
Byte 5 Clock Request Enable/Configuration Register
Bit
Pin
Name
Description
Type
0
1
Default
7
CR#_A_EN
Enable CR#_A (clk req),
PCI0_OE must be = 1 for this bit to take effect
RW
Disable CR#_A
Enable CR#_A
0
6
5
4
3
2
1
0
CR#_A_SEL
CR#_B_EN
CR#_B_SEL
CR#_C_EN
CR#_C_SEL
CR#_D_EN
CR#_D_SEL
Sets CR#_A to control either SRC0 or SRC2
Enable CR#_B (clk req)
Sets CR#_B -> SRC1 or SRC4
Enable CR#_C (clk req)
Sets CR#_C -> SRC0 or SRC2
Enable CR#_D (clk req)
Sets CR#_D -> SRC1 or SRC4
RW
RW
RW
RW
RW
RW
RW
CR#_A -> SRC0
Disable CR#_B
CR#_B -> SRC1
Disable CR#_C
CR#_C -> SRC0
Disable CR#_D
CR#_D -> SRC1
CR#_A -> SRC2
Enable CR#_B
CR#_B -> SRC4
Enable CR#_C
CR#_C -> SRC2
Enable CR#_D
CR#_D -> SRC4
0
0
0
0
0
0
0
Byte 6 Clock Request Enable/Configuration and Stop Control Register
Bit
Pin
Name
7
CR#_E_EN
6
CR#_F_EN
5
CR#_G_EN
4
CR#_H_EN
Enable CR#_H (clk req) -> SRC10
3
Reserved
2
Reserved
SSCD_STP_CRTL
(SRC1)
If set, SRCs (except SRC1) stop with
Description
Type
RW
RW
RW
RW
RW
RW
0
1
Default
0
0
0
0
0
0
Enable CR#_E (clk req) -> SRC6
Enable CR#_F (clk req) -> SRC8
Enable CR#_G (clk req) -> SRC9
Disable CR#_E
Disable CR#_F
Disable CR#_G
Disable CR#_H
Enable CR#_E
Enable CR#_F
Enable CR#_G
Enable CR#_H
Reserved
Reserved
1
If set, SSCD (SRC1) stops with PCI_STOP#
RW
Free Running
Stops with PCI_STOP#
assertion
Stops with PCI_STOP#
assertion
0
0
SRC_STP_CRTL
PCI_STOP#
RW
Free Running
0
Byte 7 Vendor ID/ Revision ID
Bit
Pin
7
Rev Code Bit 3
6
Rev Code Bit 2
5
Rev Code Bit 1
4
Rev Code Bit 0
3
Vendor ID bit 3
2
Vendor ID bit 2
1
Vendor ID bit 1
0
Vendor ID bit 0
Name
Description
Type
R
R
R
R
R
R
R
R
0
1
Default
X
X
X
X
0
0
0
1
Vendor specific
Byte 8 Device ID and Output Enable Register
Bit
Pin
Name
7
Device_ID3
6
Device_ID2
5
Device_ID1
4
Device_ID0
3
Reserved
2
Reserved
1
SE1_OE
0
SE2_OE
Description
Type
R
R
R
R
RW
RW
RW
RW
0
1
Default
0
0
0
1
0
0
0
0
See Device ID Table
Reserved
Reserved
-
-
-
-
Output enable for SE1
Output enable for SE2
Disabled
Disabled
Enabled
Enabled
Byte 9 Output Control Register
Bit
Pin
Name
Description
Type
0
1
Default
7
PCIF5 STOP EN
Allows control of PCIF5 with assertion of
PCI_STOP#
Truested Mode Enable (TME) strap status
Sets the REF output drive strength
Allows test select, ignores REF/FSC/TestSel
Allows entry into test mode, ignores
FSB/TestMode
RW
Free running
Stops with PCI_STOP#
assertion
no overclocking
2X (3 Loads)
Outputs = REF/N
0
6
5
4
TME_Readback
REF Strength
Test Mode Select
R
normal operation
1X (2Loads)
Outputs HI-Z
0
1
0
RW
RW
3
Test Mode Entry
RW
Normal operation
Test mode
0
2
IO_VOUT2
IO Output Voltage Select (Most Significant Bit)
RW
See Table 3: V_IO
Selection
(Default is 0.8V)
1
1
0
IO_VOUT1
IO_VOUT0
IO Output Voltage Select
IO Output Voltage Select (Least Significant Bit)
RW
RW
0
1
Revision ID
Vendor ID
ICS is 0001, binary
Table of Device identifier codes, used for
differentiating between CK505 package
options, etc.
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PDF描述
ICSLV810RILFT Buffer/Clock Driver
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ICSLV810 Buffer/Clock Driver
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參數(shù)描述
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ICS9LPRS142AGLF 制造商:Integrated Device Technology Inc 功能描述:IC CLK GEN PC MAIN 64TSSOP
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