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參數(shù)資料
| 型號： | IDT5T9304PGGI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 5T SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24 |
| 封裝： | GREEN, TSSOP-24 |
| 文件頁數(shù)： | 3/15頁 |
| 文件大小： | 666K |
| 代理商： | IDT5T9304PGGI |
IDT5T9304
2.5V LVDS 1:4 CLOCK BUFFER TERABUFFER II
PRELIMINARY
IIDT LVDS CLOCK BUFFER TERABUFFER II
11
IDT5T9304 REV. A JULY 23, 2007
Power Down Timing
NOTE 1: It is recommended that outputs be disabled before enterning power-down mode. It is also recommended that the outputs remain
disabled until the device completes power-up after asserting PD.
NOTE 2: The Power Down Timing diagram assumes that GL is HIGH.
NOTE 3: It should be noted that during power-down mode, the outputs are both pulled to VDD. In the Power Down Timing diagram this is
shown when Qn/Qn goes to VDIF = 0.
A1 - A1
G
VTHI
VIH
VIL
Qn - Qn
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
PD
A2 - A2
VTHI
VIH
VIL
相關PDF資料 |
PDF描述 |
|---|---|
| IDT5T9310NLGI | 5T SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC40 |
| IDT5T93GL02PGGI8 | 5T SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| IDT5T93GL04PGI8 | 5T SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24 |
| IDT5T93GL04PGGI8 | 5T SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24 |
| IDT5T93GL061PFI8 | 5T SERIES, LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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