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參數(shù)資料
| 型號： | IDT5T9306PFI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | LOW SKEW CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封裝： | TQFP-32 |
| 文件頁數(shù)： | 2/13頁 |
| 文件大?。?/td> | 88K |
| 代理商： | IDT5T9306PFI |
INDUSTRIALTEMPERATURERANGE
10
IDT5T9306
2.5VLVDS1:6CLOCKBUFFERTERABUFFERII
Power Down Timing
NOTES:
1. It is recommended that outputs be disabled before entering power-down mode. It is also recommended that the outputs remain disabled until the device completes power-up after
asserting PD.
2. The POWER DOWN TIMING diagram assumes that GL is HIGH.
3. It should be noted that during power-down mode, the outputs are both pulled to VDD. In the POWER DOWN TIMING diagram this is shown when Qn-Qn goes to VDIF = 0.
A1 - A1
G
VTHI
VIH
VIL
Qn - Qn
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
+VDIF
VDIF=0
-VDIF
PD
A2 - A2
VTHI
VIH
VIL
Differential Gate Disable/Enable Showing Runt Pulse Generation
NOTE:
1. As shown, it is possible to generate runt pulses on gate disable and enable of the outputs. It is the user's responsibility to time the G signal to avoid this problem.
tPLH
GL
G
Qn - Qn
tPGD
tPGE
VIH
VTHI
VIL
VIH
VTHI
VIL
+ VDIF
VDIF = 0
- VDIF
A[1:2] - A[1:2]
+ VDIF
VDIF = 0
- VDIF
相關(guān)PDF資料 |
PDF描述 |
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| L4960 | 2.5 A SWITCHING REGULATOR, 150 kHz SWITCHING FREQ-MAX, PZFM7 |
| L4960H | 2.5 A SWITCHING REGULATOR, 150 kHz SWITCHING FREQ-MAX, PZFM7 |
| L4971 | 3 A SWITCHING REGULATOR, 300 kHz SWITCHING FREQ-MAX, PDIP8 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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