參數(shù)資料
型號(hào)： IDT5T93GL101PFGI8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： 5T SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP44
封裝： GREEN, TQFP-44
文件頁(yè)數(shù)： 1/14頁(yè)
文件大?。?/td> 150K
代理商： IDT5T93GL101PFGI8
INDUSTRIALTEMPERATURERANGE
IDT5T93GL101
2.5VLVDS1:10GLITCHLESSCLOCKBUFFERTERABUFFERII
1
JANUARY 2007
IDT5T93GL101
INDUSTRIAL TEMPERATURE RANGE
2.5V LVDS 1:10
GLITCHLESS CLOCK BUFFER
TERABUFFER II
DESCRIPTION:
The IDT5T93GL101 2.5V differential clock buffer is a user-selectable
differentialinputtotenLVDSoutputs. Thefanoutfromadifferentialinputtoten
LVDSoutputsreducesloadingontheprecedingdriverandprovidesanefficient
clockdistributionnetwork. TheIDT5T93GL101canactasatranslatorfroma
differentialHSTL,eHSTL,LVEPECL (2.5V),LVPECL(3.3V),CML,orLVDS
input to LVDS outputs. A single-ended 3.3V / 2.5V LVTTL input can also be
usedtotranslatetoLVDSoutputs. Theredundantinputcapabilityallowsfora
glitchless change-over from a primary clock source to a secondary clock
source. Selectable inputs are controlled by SEL. During the switchover, the
outputwilldisablelowforuptothreeclockcyclesofthepreviously-selectedinput
clock. The outputs will remain low for up to three clock cycles of the newly-
selectedclock,afterwhichtheoutputswillstartfromthenewly-selectedinput.
AFSELpinhasbeenimplementedtocontroltheswitchoverincaseswherea
clocksourceisabsentorisdriventoDClevelsbelowtheminimumspecifications.
The IDT5T93GL101 outputs can be asynchronously enabled/disabled.
Whendisabled,theoutputswilldrivetothevalueselectedbytheGLpin. Multiple
power and grounds reduce noise.
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2007 Integrated Device Technology, Inc.
DSC-6741/5
FEATURES:
Guaranteed Low Skew < 75ps (max)
Very low duty cycle distortion < 100ps (max)
High speed propagation delay < 2.2ns (max)
Up to 450MHz operation
Selectable inputs
Hot insertable and over-voltage tolerant inputs
3.3V / 2.5V LVTTL, HSTL, eHSTL, LVEPECL (2.5V), LVPECL (3.3V),
CML, or LVDS input interface
Selectable differential inputs to ten LVDS outputs
Power-down mode
2.5V VDD
Available in TQFP package
APPLICATIONS:
Clock distribution
FUNCTIONAL BLOCK DIAGRAM
GL
G1
PD
A1
A2
G2
A2
SEL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
Q2
Q1
Q3
Q4
Q5
Q6
Q7
Q8
Q9
1
0
OUTPUT
CONTROL
Q10
FSEL
相關(guān)PDF資料
PDF描述
IDT5T93GL161PFI 5T SERIES, LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP64
IDT5T93GL161PFGI8 5T SERIES, LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP64
IDT5T93GL161PFGI 5T SERIES, LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP64
IDT5T93GL16NLGI 5T SERIES, LOW SKEW CLOCK DRIVER, 16 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC52
IDT5T940-30NLGI8 5T SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC28
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT5T93GL10NLGI 功能描述:IC CLK BUFFER MUX 2:10 40-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:TERABUFFER™ II 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件
IDT5T93GL10NLGI8 功能描述:IC CLK BUFFER MUX 2:10 40-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:TERABUFFER™ II 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件
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