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參數(shù)資料
| 型號(hào)： | IDT7024L15PF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 4K x 16 DUAL-PORT STATIC RAM |
| 中文描述： | 4K X 16 DUAL-PORT SRAM, 15 ns, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁(yè)數(shù)： | 11/20頁(yè) |
| 文件大?。?/td> | 292K |
| 代理商： | IDT7024L15PF |
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IDT7024S/L
HIGH-SPEED 4K x 16 DUAL-PORT STATIC RAM
MILITARY AND COMMERCIAL TEMPERATURE RANGES
6.15
11
TIMING WAVEFORM OF SEMAPHORE READ AFTER WRITE TIMING, EITHER SIDE
(1)
NOTES:
1.
CE
= V
IH
or
UB
&
LB
= V
IH
for the duration of the above timing (both write and read cycle).
2. "DATA
OUT
VALID" represents all I/O's (I/O
0
-I/O
15
) equal to the semaphore value.
NOTES:
1. D
0R
= D
0L
= V
IL
,
CE
R
=
CE
L
= V
IH
, or both
UB
&
LB
= V
IH
, Semaphore Flag is released from both sides (reads as ones from both sides) at cycle start.
2. All timing is the same for left and right ports. Port “A” may be either left or right port. Port “B” is the opposite from port “A”.
3. This parameter is measured from R/
W
A
or
SEM
A
going High to R/
W
B
or
SEM
B
going High.
4. If t
SPS
is not satisfied, there is no guarantee which side will be granted the Semaphore flag.
TIMING WAVEFORM OF SEMAPHORE WRITE CONTENTION
(1,3,4)
SEM
"A"
2740 drw 12
t
SPS
MATCH
R/
W
"A"
MATCH
A
0"A"
-A
2"A"
SIDE
“A”
(2)
SEM
"B"
R/
W
"B"
A
0"B"
-A
2"B"
SIDE
(2)
“B”
SEM
2740 drw 11
t
AW
t
EW
t
SOP
I/O
0
VALID ADDRESS
t
SAA
R/
W
t
WR
t
OH
t
ACE
VALID ADDRESS
DATA
IN
VALID
DATA
OUT
VALID
(2)
t
DW
t
WP
t
DH
t
AS
t
SWRD
t
AOE
Read Cycle
Write Cycle
A
0
-A
2
OE
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PDF描述 |
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| IDT7024L15PFG8 | 功能描述:IC SRAM 64KBIT 15NS 100TQFP RoHS:是 類別:集成電路 (IC) >> 存儲(chǔ)器 系列:- 標(biāo)準(zhǔn)包裝:72 系列:- 格式 - 存儲(chǔ)器:RAM 存儲(chǔ)器類型:SRAM - 同步 存儲(chǔ)容量:9M（256K x 36） 速度:75ns 接口:并聯(lián) 電源電壓:3.135 V ~ 3.465 V 工作溫度:-40°C ~ 85°C 封裝/外殼:100-LQFP 供應(yīng)商設(shè)備封裝:100-TQFP（14x14） 包裝:托盤(pán) 其它名稱:71V67703S75PFGI |
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