參數(shù)資料
型號： IDT7024S25JB
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： 600V N-Channel SuperFET; Package: TO-220F; No of Pins: 3; Container: Rail
中文描述： 4K X 16 DUAL-PORT SRAM, 25 ns, PQCC84
封裝： PLASTIC, LCC-84
文件頁數(shù)： 15/20頁
文件大小： 292K
代理商： IDT7024S25JB
IDT7024S/L
HIGH-SPEED 4K x 16 DUAL-PORT STATIC RAM
MILITARY AND COMMERCIAL TEMPERATURE RANGES
6.15
15
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from “A”.
2. See Interrupt truth table.
3. Timing depends on which enable signal (
CE
or R/
W
) is asserted last.
4. Timing depends on which enable signal (
CE
or R/
W
) is de-asserted first.
TRUTH TABLES
TRUTH TABLE III — INTERRUPT FLAG
(1,4)
Left Port
R/
W
L
CE
L
OE
L
A
11L
-A
0L
L
L
X
X
X
X
X
X
X
X
L
L
Right Port
OE
R
INT
L
R/
W
R
X
X
L
X
CE
R
A
11R
-A
0R
INT
X
FFF
FFE
X
R
L
(2)
H
(3)
X
X
Function
FFF
X
X
FFE
X
X
X
L
L
X
X
L
X
X
Set Right
INT
R
Flag
Reset Right
INT
R
Flag
Set Left
INT
L
Flag
Reset Left
INT
L
Flag
L
(3)
H
(2)
NOTES:
1. Assumes
BUSY
L
=
BUSY
R
= V
IH
.
2. If
BUSY
L
= V
IL
, then no change.
3. If
BUSY
R
= V
IL
, then no change.
4.
INT
R and
INT
L
must be initialized at power-up.
2740 tbl 17
WAVEFORM OF INTERRUPT TIMING
(1)
2740 drw 17
ADDR
"A"
INTERRUPT SET ADDRESS
CE
"A"
R/
W
"A"
t
AS
t
WC
t
WR
(3)
(4)
t
INS(3)
INT
"B"
(2)
2740 drw 18
ADDR
"B"
INTERRUPT CLEAR ADDRESS
CE
"B"
OE
"B"
t
AS
t
RC
(3)
t
INR(3)
INT
"B"
(2)
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PDF描述
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IDT7024S30J8 功能描述:IC SRAM 64KBIT 30NS 84PLCC RoHS:否 類別:集成電路 (IC) >> 存儲(chǔ)器 系列:- 標(biāo)準(zhǔn)包裝:72 系列:- 格式 - 存儲(chǔ)器:RAM 存儲(chǔ)器類型:SRAM - 同步 存儲(chǔ)容量:9M（256K x 36） 速度:75ns 接口:并聯(lián) 電源電壓:3.135 V ~ 3.465 V 工作溫度:-40°C ~ 85°C 封裝/外殼:100-LQFP 供應(yīng)商設(shè)備封裝:100-TQFP（14x14） 包裝:托盤 其它名稱:71V67703S75PFGI
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