參數(shù)資料
型號(hào)： IDT707278L25PFI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： Low-Noise JFET-Input Operational Amplifier 8-SOIC 0 to 70
中文描述： 32K X 16 DUAL-PORT SRAM, 25 ns, PQFP100
封裝： 14 X 14 MM, 1.40 MM HEIGHT, TQFP-100
文件頁(yè)數(shù)： 7/16頁(yè)
文件大?。?/td> 135K
代理商： IDT707278L25PFI
6.42
IDT707278S/L
32K x 16 Bank-Switchable Dual-Ported SRAM with External Bank Selects Industrial and Commercial Temperature Ranges
7
#*
Figure 1. AC Output Test Load
Figure 3. Lumped Capacitance Load Typical Derating Curve
-$01$
0#*23)
."
NOTES:
1. Transition is measured 0mV fromLow or High-impedance voltage with Output Test Load (Figure 2).
2. This parameter is guaranteed by device characterization, but is not production tested.
3. To access RAM
CE
= V
IL
and
MBSEL
= V
IH
. To access mailbox,
CE
= V
IH
and
MBSEL
= V
IL
.
4. 'X' in part numbers indicates power rating (S or L).
5. Refer to Truth Table I.
Input Pulse Levels
Input Rise/Fall Times
Input Timng Reference Levels
Output Reference Levels
Output Load
GND to 3.0V
3ns Max.
1.5V
1.5V
Figures 1,2 and 3
3739 tbl 11
3739 drw 03
893
30pF
347
5V
DATA
OUT
INT
893
5pF*
347
5V
DATA
OUT
t
ACE
/t
AA
(Typical, ns)
3739 drw 05
1
2
3
4
5
6
7
8
20 40
100
60 80
Capacitance (pF)
120 140 160 180 200
-1
0
- 10pF is the I/O capacitance
of this device, and 30pF is the
AC Test Load Capacitance
707278X15
Com'l Only
707278X20
Com'l & Ind
707278X25
Com'l & Ind
Unit
Symbol
Parameter
Mn.
Max.
Mn.
Max.
Mn.
Max.
READ CYCLE
t
RC
Read Cycle Time
15
____
20
____
25
____
ns
t
AA
Address Access Time
____
15
____
20
____
25
ns
t
ACE
Chip Enable Access Time
(3)
____
15
____
20
____
25
ns
t
ABE
Byte Enable Access Time
(3)
____
15
____
20
____
25
ns
t
AOE
Output Enable Access Time
____
9
____
10
____
11
ns
t
OH
Output Hold fromAddress Change
3
____
3
____
3
____
ns
t
LZ
Output Low-Z Time
(1,2)
0
____
0
____
0
____
ns
t
HZ
Output High-Z Time
(1,2)
____
8
____
9
____
10
ns
t
PU
Chip Enable to Power Up Time
(2,5)
0
____
0
____
0
____
ns
t
PD
Chip Disable to Power Down Time
(2,5)
____
15
____
20
____
25
ns
t
MOP
Mailbox Flag Update Pulse (
OE
or
MBSEL
)
10
____
10
____
10
____
ns
t
MAA
Mailbox Address Access Time
____
15
____
20
____
25
ns
3739 tbl 12
Figure 2. Output Test Load
(for t
LZ
, t
HZ
, t
WZ
, t
OW
)
*Including scope and jig.
相關(guān)PDF資料
PDF描述
IDT707278S HIGH-SPEED 32K x 16 BANK-SWITCHABLE DUAL-PORTED SRAM WITH EXTERNAL BANK SELECTS
IDT707278S15PF Low-Noise JFET-Input Operational Amplifier 8-PDIP 0 to 70
IDT707278S15PFI Low-Noise JFET-Input Operational Amplifier 8-PDIP 0 to 70
IDT70824S45PF HIGH-SPEED 4K X 16 SEQUENTIAL ACCESS RANDOM ACCESS MEMORY (SARAM⑩)
IDT70824S45PFB HIGH-SPEED 4K X 16 SEQUENTIAL ACCESS RANDOM ACCESS MEMORY (SARAM⑩)
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參數(shù)描述
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