參數(shù)資料
型號(hào)： IDT70V639S15BF
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： HIGH-SPEED 3.3V 128K x 18 ASYNCHRONOUS DUAL-PORT STATIC RAM
中文描述： 128K X 18 DUAL-PORT SRAM, 15 ns, PBGA208
封裝： 15 X 15 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, FPBGA-208
文件頁(yè)數(shù)： 1/23頁(yè)
文件大?。?/td> 187K
代理商： IDT70V639S15BF
2001 Integrated Device Technology, Inc.
DSC-5621/3
1
CE
0R
CE
1R
R/
W
R
LB
R
UB
R
128K x 18
MEMORY
ARRAY
Address
Decoder
A
16R
A
0R
Address
Decoder
CE
0L
CE
1L
R/
W
L
LB
L
UB
L
Dout0-8_L
Dout9-17_L
Dout0-8_R
Dout9-17_R
B
E
0
L
B
E
1
L
B
E
1
R
B
E
0
R
I/O
0L
- I/O
17L
I/O
0R
- I/O
17R
Din_L
ADDR_L
Din_R
ADDR_R
OE
R
OE
L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
SEM
L
INT
L
BUSY
L
M/
S
R/
W
L
OE
L
R/
W
R
OE
R
BUSY
R
SEM
R
INT
R
CE
0L
CE
1L
CE
0R
CE
1R
TMS
TCK
TRST
TDI
TDO
JTAG
5621 drw 01
A
16L
A
0L
N
Fully asynchronous operation from either port
N
Separate byte controls for multiplexed bus and bus
matching compatibility
N
Supports JTAG features compliant to IEEE 1149.1
– Due to limted pin count, JTAG is not supported on the
128-pin TQFP package.
N
LVTTL-compatible, single 3.3V (±150mV) power supply for
core
N
LVTTL-compatible, selectable 3.3V (±150mV)/2.5V (±100mV)
power supply for I/Os and control signals on each port
N
Available in a 128-pin Thin Quad Flatpack, 208-ball fine
pitch Ball Grid Array, and 256-ball Ball Grid Array
N
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
N
True Dual-Port memory cells which allow simultaneous
access of the same memory location
N
High-speed access
– Commercial: 10/12/15ns (max.)
– Industrial: 12/15ns (max.)
N
Dual chip enables allow for depth expansion without
external logic
N
IDT70V639 easily expands data bus width to 36 bits or
more using the Master/Slave select when cascading more
than one device
N
M/
S
= V
IH
for
BUSY
output flag on Master,
M/
S
= V
IL
for
BUSY
input on Slave
N
Busy and Interrupt Flags
N
On-chip port arbitration logic
N
Full on-chip hardware support of semaphore signaling
between ports
HIGH-SPEED 3.3V 128K x 18
ASYNCHRONOUS DUAL-PORT
STATIC RAM
PRELIMINARY
IDT70V639S
NOTES:
1.
2.
BUSY
is an input as a Slave (M/
S
=V
IL
) and an output when it is a Master (M/
S
=V
IH
).
BUSY
and
INT
are non-tri-state totem-pole outputs (push-pull).
相關(guān)PDF資料
PDF描述
IDT70V639S15BFI HIGH-SPEED 3.3V 128K x 18 ASYNCHRONOUS DUAL-PORT STATIC RAM
IDT70V639S15PRF HIGH-SPEED 3.3V 128K x 18 ASYNCHRONOUS DUAL-PORT STATIC RAM
IDT70V639S15PRFI HIGH-SPEED 3.3V 128K x 18 ASYNCHRONOUS DUAL-PORT STATIC RAM
IDT70V7319S HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
IDT70V7319S133BC HIGH-SPEED 3.3V 256K x 18 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
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參數(shù)描述
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