參數(shù)資料
型號(hào): IDT70V7599S133DRI
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: HIGH-SPEED 3.3V 128K x 36 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE
中文描述: 128K X 36 DUAL-PORT SRAM, 15 ns, PQFP208
封裝: 28 X 28 MM, 3.50 MM HEIGHT, PLASTIC, QFP-208
文件頁(yè)數(shù): 20/22頁(yè)
文件大?。?/td> 489K
代理商: IDT70V7599S133DRI
6.42
IDT70V7599S
High-Speed 128K x 36 Synchronous Bank-Switchable Dual-Port Static RAM Industrial and Commercial Temperature Ranges
JTAG Timing Specifications
t
JCYC
t
JF
t
JCL
t
JR
t
JCH
JTAG AC Electrical
Characteristics
(1,2,3,4)
70V7599
Symbol
Parameter
Mn.
Max.
Units
t
J CYC
JTAG Clock Input Period
100
____
ns
t
JCH
JTAG Clock HIGH
40
____
ns
t
JCL
JTAG Clock Low
40
____
ns
t
JR
JTAG Clock Rise Time
____
3
(1)
ns
t
JF
JTAG Clock Fall Time
____
3
(1)
ns
t
JRST
JTAG Reset
50
____
ns
t
J RSR
JTAG Reset Recovery
50
____
ns
t
JCD
JTAG Data Output
____
25
ns
t
JDC
JTAG Data Output Hold
0
____
ns
t
JS
JTAG Setup
15
____
ns
t
JH
JTAG Hold
15
____
ns
5626 tbl 12
NOTES:
1. Guaranteed by design.
2. 30pF loading on external output signals.
3. Refer to AC Electrical Test Conditions stated earlier in this document.
4. JTAG operations occur at one speed (10MHz). The base device may run at
any speed specified in this datasheet.
TCK
Device Inputs
(1)
/
TDI/TMS
Device Outputs
(2)
/
TDO
TRST
t
JCD
t
JDC
t
JRST
t
JS
t
JH
t
JRSR
5626 drw 21
,
Figure 5. Standard JTAG Timing
NOTES:
1. Device inputs = All device inputs except TDI, TMS, TRST, and TCK.
2. Device outputs = All device outputs except TDO.
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PDF描述
IDT70V9089L9PF HIGH-SPEED 3.3V 64/32K x 8 SYNCHRONOUS DUAL-PORT STATIC RAM
IDT70V9079S HIGH-SPEED 3.3V 64/32K x 8 SYNCHRONOUS DUAL-PORT STATIC RAM
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IDT70V9079L12PF HIGH-SPEED 3.3V 64/32K x 8 SYNCHRONOUS DUAL-PORT STATIC RAM
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參數(shù)描述
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