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參數(shù)資料
| 型號： | IDT71V25781S200BGI |
| 廠商： | Integrated Device Technology, Inc. |
| 元件分類： | 通用總線功能 |
| 英文描述： | 128K X 36, 256K X 18 3.3V Synchronous SRAMs 2.5V I/O, Pipelined Outputs, Burst Counter, Single Cycle Deselect |
| 中文描述： | 128K的米鼠36，256 × 18 3.3同步SRAM的2.5VI / O的流水線輸出，脈沖計數(shù)器，單周期取消 |
| 文件頁數(shù)： | 12/23頁 |
| 文件大?。?/td> | 526K |
| 代理商： | IDT71V25781S200BGI |
6.42
12
IDT71V25761, IDT71V25781, 128K x 36, 256K x 18, 3.3V Synchronous SRAMs with
2.5V I/O, Pipelined Outputs, Burst Counter, Single Cycle Deselect Commercial and Industrial Temperature Ranges
AC Electrical Characteristics
(V
DD
= 3.3V ±5%, Commercial and Industrial Temperature Ranges)
NOTES:
1. Measured as HIGH above V
IH
and LOW below V
IL
.
2. Transition is measured ±200mV fromsteady-state.
3. Device must be deselected when powered-up fromsleep mode.
4. t
CFG
is the mnimumtime required to configure the device based on the
LBO
input.
LBO
is a static input and must not change during normal operation.
5. Commercial temperature range only.
200MHz
(5)
183MHz
166MHz
Symbol
Parameter
Mn.
Max.
Mn.
Max.
Mn.
Max.
Unit
t
CYC
Clock Cycle Time
5
____
5.5
____
6
____
ns
t
CH
(1)
Clock High Pulse Width
2
____
2.2
____
2.4
____
ns
t
CL
(1)
Clock LowPulse Width
2
____
2.2
____
2.4
____
ns
Output Parameters
t
CD
Clock High to Valid Data
____
3.1
____
3.3
____
3.5
ns
t
CDC
Clock High to Data Change
1.0
____
1.0
____
1.0
____
ns
t
CLZ
(2)
Clock High to Output Active
0
____
0
____
0
____
ns
t
CHZ
(2)
Clock High to Data High-Z
1.5
3.1
1.5
3.3
1.5
3.5
ns
t
OE
Output Enable Access Time
____
3.1
____
3.3
____
3.5
ns
t
OLZ
(2)
Output Enable Lowto Output Active
0
____
0
____
0
____
ns
t
OHZ
(2)
Output Enable High to Output High-Z
____
3.1
____
3.3
____
3.5
ns
Set Up Times
t
SA
Address Setup Time
1.2
____
1.5
____
1.5
____
ns
t
SS
Address Status Setup Time
1.2
____
1.5
____
1.5
____
ns
t
SD
Data In Setup Time
1.2
____
1.5
____
1.5
____
ns
t
SW
Write Setup Time
1.2
____
1.5
____
1.5
____
ns
t
SAV
Address Advance Setup Time
1.2
____
1.5
____
1.5
____
ns
t
SC
Chip Enable/Select Setup Time
1.2
____
1.5
____
1.5
____
ns
Hold Times
t
HA
Address Hold Time
0.4
____
0.5
____
0.5
____
ns
t
HS
Address Status Hold Time
0.4
____
0.5
____
0.5
____
ns
t
HD
Data In Hold Time
0.4
____
0.5
____
0.5
____
ns
t
HW
Write Hold Time
0.4
____
0.5
____
0.5
____
ns
t
HAV
Address Advance Hold Time
0.4
____
0.5
____
0.5
____
ns
t
HC
Chip Enable/Select Hold Time
0.4
____
0.5
____
0.5
____
ns
Sleep Mode and Configuration Parameters
t
ZZPW
ZZ Pulse Width
100
____
100
____
100
____
ns
t
ZZR
(3)
ZZ Recovery Time
100
____
100
____
100
____
ns
t
CFG
(4)
Configuration Set-up Time
20
____
22
____
24
____
ns
4876 tbl 16
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PDF描述 |
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