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參數(shù)資料
| 型號： | IDT71V321S35JI |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| 中文描述： | 的高速中斷3.3V的2K × 8雙端口靜態(tài)RAM |
| 文件頁數(shù)： | 1/14頁 |
| 文件大?。?/td> | 129K |
| 代理商： | IDT71V321S35JI |
2001 Integrated Device Technology, Inc.
DSC-3026/8
1
HIGH SPEED 3.3V
2K X 8 DUAL-PORT
STATIC RAM WITH INTERRUPTS
IDT71V321S/L
IDT71V421S/L
N
High-speed access
– Commercial: 25/35/55ns (max.)
– Industrial: 25ns (max.)
N
Low-power operation
– IDT71V321/IDT71V421S
—
Active: 325mW (typ.)
—
Standby: 5mW (typ.)
– IDT71V321/V421L
—
Active: 325mW (typ.)
—
Standby: 1mW (typ.)
N
Two
INT
flags for port-to-port communications
NOTES:
1. IDT71V321 (MASTER):
BUSY
is an output. IDT71V421 (SLAVE):
BUSY
is input.
2.
BUSY
and
INT
are totem-pole outputs.
N
MASTER IDT71V321 easily expands data bus width to 16-
or-more-bits using SLAVE IDT71V421
N
On-chip port arbitration logic (IDT71V321 only)
N
BUSY
output flag on IDT71V321;
BUSY
input on IDT71V421
N
Fully asynchronous operation from either port
N
Battery backup operation—2V data retention (L only)
N
TTL-compatible, single 3.3V power supply
N
Available in 52-pin PLCC, 64-pin TQFP and STQFP
packages
N
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
I/O
Control
Address
Decoder
MEMORY
ARRAY
ARBITRATION
and
INTERRUPT
LOGIC
Address
Decoder
I/O
Control
R/
W
L
CE
L
OE
L
BUSY
L
A
10L
A
0L
3026 drw 01
I/O
0L
- I/O
7L
CE
L
OE
L
R/
W
L
INT
L
BUSY
R
I/O
0R
-I/O
7R
A
10R
A
0R
INT
R
CE
R
OE
R
R/
W
R
(2)
(1,2)
(1,2)
(2)
R/
W
R
CE
R
OE
R
11
11
相關(guān)PDF資料 |
PDF描述 |
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