IDT72801/728211/72821/72831/72841/72851 DUAL CMOS SyncFIFOTM DUAL 256 x 9, DUAL 512 x 9, DUAL 1K x 9" />
參數(shù)資料
型號(hào): IDT72851L25PF8
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 2/16頁(yè)
文件大?。?/td> 0K
描述: IC FIFO SYNC 4096X18 25NS 64QFP
標(biāo)準(zhǔn)包裝: 750
系列: 7200
功能: 同步
存儲(chǔ)容量: 72K(4K x 18)
數(shù)據(jù)速率: 40MHz
訪問時(shí)間: 25ns
電源電壓: 4.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(14x14)
包裝: 帶卷 (TR)
其它名稱: 72851L25PF8
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IDT72801/728211/72821/72831/72841/72851 DUAL CMOS SyncFIFOTM
DUAL 256 x 9, DUAL 512 x 9, DUAL 1K x 9, DUAL 2K x 9, DUAL 4K x 9, DUAL 8K x 9
COMMERCIAL AND INDUSTRIAL
TEMPERATURERANGES
MARCH 2013
NOTE:
1. tSKEW1 is the minimum time between a rising WCLKA (WCLKB) edge and a rising RCLKA (RCLKB) edge for EFA (EFB) to change during the current clock cycle. If the time
between the rising edge of RCLKA (RCLKB) and the rising edge of WCLKA (WCLKB) is less than tSKEW1, then EFA (EFB) may not change state until the next RCLKA (RCLKB)
Figure 6. Read Cycle Timing
tENH
tENS
NO OPERATION
tOLZ
VALID DATA
tSKEW1
(1)
tCLK
tCLKH
tCLKL
tREF
tA
tOE
tOHZ
RCLKA (RCLKB)
RENA1, RENA2
(
RENB1, RENB2)
EFA (EFB)
QA0 - QA8
(QB0 - QB8)
OEA (OEB)
WCLKA (WCLKB)
WENA1 (WENB1)
WENA2 (WENB2)
3034 drw 07
tDS
D0 (First Valid Write)
tSKEW1
D0
D1
D3
D2
D1
tENS
tFRL
(1)
tREF
tA
tOLZ
tOE
tA
WCLKA (WCLKB)
DA0 - DA8
(DB0 - DB8)
WENA2 (WENB2)
(If Applicable)
RCLKA (RCLKB)
EFA (EFB)
RENA1, RENA2
(
RENB1, RENB2)
QA0 - QA8
(QB0 - QB8)
OEA (OEB)
WENA1 (WENB1)
3034 drw 08
tENS
NOTE:
1. When tSKEW1
≥ minimum specification, tFRL = tCLK + tSKEW1
When tSKEW1
< minimum specification, tFRL = 2tCLK + tSKEW1V or tCLK + tSKEW1
The Latency Timings apply only at the Empty Boundary (EFA, EFB = LOW).
Figure 7. First Data Word Latency Timing
相關(guān)PDF資料
PDF描述
IDT72821L15PFI8 IC FIFO SYNC 1KX9 15NS 64QFP
LTC1689CS IC DVR 100MBPS RS485 QUAD 16SOIC
AD7886JP IC ADC 12BIT SAMPLING HS 28-PLCC
IDT72821L10PFG8 IC FIFO SYNC 1KX9 10NS 64QFP
LTC1688CS IC DVR 100MBPS RS485 QUAD 16SOIC
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參數(shù)描述
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