參數(shù)資料
型號(hào)： IDT7290820J8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 13/27頁(yè)
文件大?。?/td> 0K
描述： IC DGTL SW 2048X2048 84-PLCC
標(biāo)準(zhǔn)包裝： 200
系列： 7200
類型： 多路復(fù)用器
電路： 1 x 16:16
獨(dú)立電路： 1
電壓電源： 單電源
電源電壓： 4.75 V ~ 5.25 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 84-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 84-PLCC（29.21x29.21）
包裝： 帶卷 (TR)
其它名稱： 7290820J8
20
COMMERCIALTEMPERATURERANGE
IDT7290820 5V TIME SLOT INTERCHANGE
DIGITAL SWITCH 2,048 x 2,048
AC ELECTRICAL CHARACTERISTICS - .RAME PULSE AND CLK
NOTE:
1. High Impedance is measured by pulling to the appropriate rail with R
L, with timing corrected to cancel time taken to discharge CL.
Symbol
Characteristics
Min.
Typ.
Max.
Units
tFPW
Frame Pulse Width (ST-BUS, GCI)
Bit rate = 2.048 Mb/s
26
295
ns
Bit rate = 4.096 Mb/s
26
145
ns
Bit rate = 8.192 Mb/s
26
80
ns
tFPS
Frame Pulse Setup time before CLK falling (ST-BUS or GCI)
10
ns
tFPH
Frame Pulse Hold Time from CLK falling (ST-BUS or GCI)
16
ns
tCP
CLK Period
Bit rate = 2.048 Mb/s
190
300
ns
Bit rate = 4.096 Mb/s
110
150
ns
Bit rate = 8.192 Mb/s
55
70
ns
tCH
CLK Pulse Width HIGH
Bit rate = 2.048 Mb/s
85
150
ns
Bit rate = 4.096 Mb/s
50
75
ns
Bit rate = 8.192 Mb/s
20
40
ns
tCL
CLK Pulse Width LOW
Bit rate = 2.048 Mb/s
85
150
ns
Bit rate = 4.096 Mb/s
50
75
ns
Bit rate = 8.192 Mb/s
20
40
ns
tr, tf
Clock Rise/Fall Time
10
ns
tHFPW
Wide Frame Pulse Width
Bit rate = 8.192 Mb/s
195
295
ns
tHFPS
Frame Pulse Setup Time before HCLK falling
10
150
ns
tHFPH
Frame Pulse Hold Time from HCLK falling
20
150
ns
tHCP
HCLK (4.096 MHz) Period
Bit rate = 8.192 Mb/s
190
300
ns
tHCH
HCLK (4.096 MHz) Pulse Width HIGH
Bit rate = 8.192 Mb/s
85
150
ns
tHCL
HCLK (4.096 MHz) Pulse Width LOW
Bit rate = 8.192 Mb/s
85
150
ns
tHr,tHf
HCLK Rise/Fall Time
10
ns
tDIF
Delay between falling edge of HCLK and falling edge of CLK
-10
10
ns
Symbol
Characteristics
Min.
Typ.
Max.
Unit
Test Conditions
tSIS
RX Setup Time
0
ns
tSIH
RX Hold Time
20
ns
tSOD
TX Delay – Active to Active
39
ns
C
L = 30pF
58
ns
C
L = 200pF
tDZ
TX Delay – Active to High-Z
37
ns
R
L = 1K, CL = 200pF
tZD
TX Delay – High-Z to Active
37
ns
R
L = 1K, CL = 200pF
tODE
Output Driver Enable (ODE) Delay
37
ns
R
L = 1K, CL = 200pF
tXCD
CCO Output Delay
48
ns
C
L = 30pF
58
ns
C
L = 200pF
AC ELECTRICAL CHARACTERISTICS - SERIAL STREAMS (1)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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