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參數資料
| 型號： | IDT82P2282PF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 337/381頁 |
| 文件大?。?/td> | 0K |
| 描述： | TXRX T1/J1/E1 2CHAN 100-TQFP |
| 標準包裝： | 15 |
| 類型： | 收發(fā)器 |
| 驅動器/接收器數： | 2/2 |
| 規(guī)程： | T1/E1/J1 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-TQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 82P2282PF |
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IDT82P2282
DUAL T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
59
August 20, 2009
3.12
BIT-ORIENTED MESSAGE RECEIVER
The Bit-Oriented Message (BOM) can only be received in the ESF
format in T1/J1 mode.
The BOM pattern is ‘111111110XXXXXX0’ which occupies the DL of
the F-bit in the ESF format (refer to Table 13). The six ‘X’s represent the
message. The BOM is declared only when the pattern is matched and
the received message is identical 4 out of 5 consecutive times or 8 out of
10 consecutive times and differs from the previous message. The identi-
fication time is selected by the AVC bit. After a new BOM is declared, the
message is loaded into the BOC[5:0] bits. Every time when the BOC[5:0]
bits are updated, it will be indicated by the BOCI bit. A ‘1’ in the BOCI bit
means there is an interrupt. The interrupt will be reported by the INT pin
if the BOCE bit is ‘1’.
In BITS application, network timing recovery is required. In addition
to timing recovery, the incoming line can carry Synchronization Status
Messages, or SSM, to indicate the quality level of the incoming clock.
SSM (in code words) are transmitted and/or received through the data
link bits (DS1 ESF formats) in T1/J1 mode. XBOC[5:0] and BOC[5:0]
mode can be used to transmit and receive the code words of SSM,
respectively. In E1 mode, Sa bits in Time Slot 0 can be used for transmit
or receive SSM code words.
In T1/J1 ESF mode, the BOC[5:0] bits can be used to hold the
received codeword in SSM application. The XBOC[5:0] bits, on the other
hand, can be used to transmit the SSM codeword to the network far end.
In E1 mode, each of the Sa[4:8] bits can be used for the same pur-
pose. For example, if the Sa[4] bit is used in transmit direction, SSM is
transmitted by using the Sa[4] bit; in receive direction, the E1 Sa4 Code-
word Register contains the received SSM codeword.
3.13
INBAND LOOPBACK CODE DETECTOR (T1/J1
ONLY)
The Inband Loopback Code Detector tracks the loopback activate/
deactivate codes only in framed or unframed T1/J1 data stream, and
meets ANSI T1.403 9.3.1.
The received data stream is compared with the target activate/
deactivate code whose length and content are programmed in the
ASEL[1:0]/DSEL[1:0] bits and the ACT[7:0]/DACT[7:0] bits respectively.
In framed mode, the F-bit is selected by the IBCDIDLE bit to compare
with the target activate/deactivate code or not. In unframed mode, all
193 bits are compared with the target activate/deactivate code.
After four consecutive correct activate/deactivate codes are found
in the received data stream, the Inband Loopback Code Detector keeps
on monitoring the bit error, i.e., the bit differs from the target activate/
deactivate code. If in more than 126 consecutive 39.8ms fixed periods,
less than 600 bit errors are detected in each 39.8ms, the activate/deacti-
vate code is detected and the corresponding LBA/LBD bit will indicate it.
Once more than 600 bit errors are detected in a 39.8ms fixed period, the
activate/deactivate code is out of synchronization and the corresponding
LBA/LBD bit will be cleared. However, even if the F-bit is compared,
whether it is matched or not, the result will not cause bit errors, that is,
the comparison result of the F-bit is discarded.
Any transition (from ‘0’ to ‘1’ or from ‘1’ to ‘0’) on the LBA/LBD bit
will set the LBAI/LBDI bit, which means there is an interrupt. The inter-
rupt will be reported by the INT pin if the corresponding LBAE/LBDE bit
is set to ‘1’.
Table 32: Related Bit / Register In Chapter 3.12
Bit
Register
T1/J1 Address (Hex)
AVC
BOC Control
081, 181
BOCE
BOC[5:0]
RBOC Code
083, 183
BOCI
BOC Interrupt Indication
082, 182
XBOC[5:0]
T1/J1 XBOC Code
080, 180
Sa[4:8]
E1 TS0 International / National
054, 154
Sa4[1:4]
E1 Sa4 Codeword
056, 156
Table 33: Related Bit / Register In Chapter 3.13
Bit
Register
T1/J1 Address (Hex)
ASEL[1:0]
IBCD Detector Configuration
076, 176
DSEL[1:0]
IBCDIDLE
ACT[7:0]
IBCD Activate Code
078, 178
DACT[7:0]
IBCD Deactivate Code
079, 179
LBA
IBCD Detector Status
077, 177
LBD
LBAI
IBCD Interrupt Indication
07B, 17B
LBDI
LBAE
IBCD Interrupt Control
07A, 17A
LBDE
相關PDF資料 |
PDF描述 |
|---|---|
| IDT82P2284BB | TXRX T1/J1/E1 4CHAN 208-PBGA |
| IDT82P2288BBG | TXRX OCTAL T1/E1/J1 256-PBGA |
| IDT82P2521BHG | IC LIU E1 21+1CH SHORT 640-PBGA |
| IDT82P2816BBG | IC LINE INTERFACE UNIT 416-PBGA |
| IDT82P2821BH | IC LIU T1/J1/E1 21+1CH 640-PBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| IDT82P2282PF8 | 功能描述:TXRX T1/J1/E1 2CHAN 100-TQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 驅動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅動器/接收器數:2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2282PFBLANK | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver |
| IDT82P2282PFG | 功能描述:IC TXRX T1/J1/E1 2CH 100TQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 驅動器，接收器，收發(fā)器 系列:- 標準包裝:2,500 系列:- 類型:驅動器 驅動器/接收器數:4/0 規(guī)程:RS422 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應商設備封裝:16-SOIC N 包裝:帶卷 (TR) |
| IDT82P2282PFG8 | 功能描述:TXRX T1/J1/E1 2CHAN 100-TQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 驅動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅動器/接收器數:2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2282PFGBLANK | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Dual T1/E1/J1 Long Haul / Short Haul Transceiver |
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