參數(shù)資料
型號(hào)： IDTCV119EPVG
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 13/21頁(yè)
文件大?。?/td> 0K
描述： IC CLK GEN DESKTOP PC 48-SSOP
標(biāo)準(zhǔn)包裝： 30
類型： 時(shí)鐘/頻率發(fā)生器
PLL： 是
主要目的： SATA CPU
輸入： 晶體
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:21
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 533MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 48-BSSOP（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 48-SSOP
包裝： 管件
其它名稱： CV119EPVG
COMMERCIALTEMPERATURERANGE
20
IDTCV119E
CLOCKGENERATORFORDESKTOPPCPLATFORMS
PD#DE-ASSERTION
The time from the de-assertion of PD# or until power supply ramps to get stable clocks will be less than 1.8ms. If the drive mode control bit for PD# tristate
is programmed to ‘1’ the stopped differential pair must first be driven high to a minimum of 200mV in less than 300s of PD# deassertion.
PWRDWN#
CPU 133MHz
CPU# 133MHz
SRC 100MHz
SRC# 100MHz
USB 48MHz
PCI 33MHz
REF 14.31818
tSTABLE <1.8mS
tDRIVE_PWRDWN#
<300
μS, <200mV
N PROGRAMMING JITTER MEASUREMENT
Tested on IDT test board, 10" trace, 10pF loading.
Measured at CPU0, differential active probe.
Data showed may vary due to CMOS process.
100MHz MODE
N =
Output Freq. (MHz)
CPU Jitter (ps)
200h (512)
115
80
300h (768)
172
51
3FFh (1023)
229
65
166MHz MODE
N =
Output Freq. (MHz)
CPU Jitter (ps)
200h (512)
204
71
300h (768)
305
72
3FFh (1023)
407
92
133MHz MODE
N =
Output Freq. (MHz)
CPU Jitter (ps)
200h (512)
153
76
300h (768)
229
79
3FFh (1023)
306
72
200MHz MODE
N =
Output Freq. (MHz)
CPU Jitter (ps)
200h (512)
229
68
300h (768)
344
84
3FFh (1023)
458
82
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PDF描述
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參數(shù)描述
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