參數(shù)資料
型號： IDTCV119EPVG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 16/21頁
文件大?。?/td> 0K
描述： IC CLK GEN DESKTOP PC 48-SSOP
標(biāo)準(zhǔn)包裝： 30
類型： 時鐘/頻率發(fā)生器
PLL： 是
主要目的： SATA CPU
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:21
差分 - 輸入:輸出： 無/是
頻率 - 最大： 533MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 48-BSSOP（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 48-SSOP
包裝： 管件
其它名稱： CV119EPVG
COMMERCIALTEMPERATURERANGE
4
IDTCV119E
CLOCKGENERATORFORDESKTOPPCPLATFORMS
PIN DESCRIPTION
Pin Number
Name
Type
Description
1
FS1/REF0
I/O
Frequency select latch input 3.3V input HIGH/LOW voltage/ 14.318MHz reference clock output(1)
2
FS0/REF1
I/O
Frequency select latch input 2.5V input HIGH/LOW voltage/ 14.318MHz reference clock output(1)
3VDD_REF
PWR
3.3V
4
X1
I N
Xtalinput
5
X2
OUT
Xtaloutput
6VSS
GND
7
PCIF0
I/O
Frequency select latch input 3.3V input HIGH/LOW voltage/ PCI free running clock(2)
8
PCIF1
OUT
PCI free running clock
9
PCIF2
OUT
PCI free running clock
10
VDD_PCI
PWR
3.3V
11
VSS
GND
12
PCI0
OUT
PCI clock
13
PCI1
OUT
PCI clock
14
PCI2
OUT
PCI clock
15
PCI3
OUT
PCI clock
16
VDD_PCI
PWR
3.3V
17
VSS
GND
18
PCI4
OUT
PCI clock
19
PCI5
OUT
PCI clock
20
RESET#/PD#
OUT
Resetoutputsignalfromwatchdogcircuit,activeLOW/powerdowncontrolinput. Modeselectablethrough
SM bus, power on is RESET# mode.(1) Byte 34 bit 5.
21
SEL24/24_48MHz#
OUT
24/48MHz clock output, LOW 48MHz(2)
22
48MHz0
OUT
48MHz clock output. Phase is 180 different with 24_48, 48MHz1, and VCH. Output drive stength can
be doubled through SM programming.
23
VSS
GND
24
VDD48
PWR
3.3V
25
3V66_3/VCH
OUT
66MHz or 48MHz clock output. Selectable by SM Bus. Power on is 66MHz.
26
3V66_2
OUT
66MHz clock output
27
VDD_3V66
PWR
3.3V
28
VSS
GND
29
3V66_1
OUT
66MHz clock output
30
RESET#
OUT
RESET#
31
SCLK
I N
SMBus clock(1)
32
SDATA
I/O
SMBus data(1)
33
VTT_PWRGD#
I N
Used for power on latch, active LOW(1)
34
VDD_SRC
PWR
3.3V
35
SRCC
OUT
SATA 0.7V current mode differential clock output
36
SRCT
OUT
SATA 0.7V current mode differential clock output
37
VSS
GND
38
CPUC0
OUT
Hosts 0.7V current mode differential clock output
39
CPUT0
OUT
Hosts 0.7V current mode differential clock output
40
VDD_CPU
PWR
3.3V
NOTES:
1. ~ 130K
Ω internal pull-up.
2. ~ 130K
Ω internal pull-down.
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PDF描述
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