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參數(shù)資料
型號： IDTCV133PAG8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 16/26頁
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描述： IC FLEXPC CLK PROGR P4 56-TSSOP
產(chǎn)品變化通告： Product Discontinuation 19/Jul/2010
標(biāo)準(zhǔn)包裝： 2,000
系列： FlexPC™
類型： PC 時鐘
PLL： 是
主要目的： Intel CPU 服務(wù)器
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:17
差分 - 輸入:輸出： 無/是
頻率 - 最大： 400MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 56-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 56-TSSOP
包裝： 帶卷 (TR)
其它名稱： CV133PAG8
COMMERCIALTEMPERATURERANGE
IDTCV133
PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR
23
Symbol
Parameter
Min.
Typ.
Max.
Unit
tPZL
Output Enable Delay (All Outputs)(1)
0—
10
μs
tPZH
tPLZ
Output Disable Delay (All Outputs)(1)
0—
10
μs
tPHZ
tSTABLE
All Clock Stabilization from Power-Up(2)
——
3
ms
tSPREAD
Setting Period for Spread Selection Change(2,3)
——
3
ms
MISCELLANEOUS AC TIMING REQUIREMENTS
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: TA = 0°C to +70°C
NOTES:
1.
These specifications apply to the LVDS and SMBus pins. These pins must be tri-stated when PWRDWN is asserted. LVDS is driven differential when PWRDWN is de-asserted unless
it is disabled.
2.
The time specified is from when VDD achieves its nominal operating level (typical condition VDD = 3.3V) and PWRDWN is de-asserted until the frequency output is stable and operating
within specification.
3.
The time specified is measured from the spread selection change or output frequency change until the LVDS clock is operating at the new spread modulation and frequency.
If there is another change in spread selection or output frequency during the tSPREAD settling period, then the settling period start resets to the most recent change in spread selection
and output frequency.
相關(guān)PDF資料
PDF描述
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VI-24P-MX-F3 CONVERTER MOD DC/DC 13.8V 75W
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D38999/24FH53SC CONN RCPT 53POS JAM NUT W/SCKT
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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IDTCV140 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
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