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參數(shù)資料
| 型號(hào)： | IDTCV149PA |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁(yè)數(shù)： | 1/17頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FLEXPC CLK PROGR K8 56-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 35 |
| 系列： | FlexPC™ |
| 類型： | PC 時(shí)鐘 |
| PLL： | 是 |
| 主要目的： | AMD CPU |
| 輸入： | 晶體 |
| 輸出： | 時(shí)鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:21 |
| 差分 - 輸入:輸出： | 無(wú)/是 |
| 頻率 - 最大： | 400MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-TFSOP（0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 56-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | CV149PA |
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COMMERCIALTEMPERATURERANGE
IDTCV149
PROGRAMMABLEFLEXPC CLOCKFORAMDK8PROCESSORATIRS480
1
MAY 2004
IDTCV149
COMMERCIAL TEMPERATURE RANGE
PROGRAMMABLE FLEXPC
CLOCK FOR AMD K8
PROCESSOR ATI RS480
SRC
SSC
N Programming
SRC
CPU[1:0]
SRC[2:1]
USB48
24_48MHz
PCI0
SRC[7:3], 0
PCI/
SRC/
Host/
48MHz/
SRC PLL
SSC
N Programming
CPU PLL
SSC
N Programming
Fixed PLL
No SSC
14.318MHz
Osc
Reset#
HTT66
CLKREQ0#
CLKREQ1#
TURBO1#
REF[2:0]
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2004 Integrated Device Technology, Inc.
DSC - 6497/2
FEATURES:
One high precision N and SSC programmable PLL for CPU
One high precision N and SSC programmable PLL for SRC[2:1]
One high precision N and SSC programmable PLL for SRC0
[7:3] (PCI Express)
One high precision PLL for 48MHz
Band-gap circuit for differential outputs
Support multiple spread spectrum modulation, down and
center
Support SMBus block read/write, index read/write
Selectable output strength for REF, PCI, 48MHz, HTT66
Available in SSOP and TSSOP packages
FUNCTIONAL BLOCK DIAGRAM
DESCRIPTION:
IDTCV149 is a 56 pin clock device for AMD advance K8 processors. The
CPU output buffer is designed to support up to 400MHz processor. This device
alsoimplementsBand-gapreferencedIREFtoreducetheimpactofVDDvariation
on differential outputs, which can provide more robust system performance.
Each CPU/SRC clock has its own Spread Spectrum selection, which allows
for isolated changes instead of affecting other clock groups.
KEY SPECIFICATION:
CPU CLK cycle to cycle jitter < 85ps
SRC CLK cycle to cycle jitter < 100ps
Static PLL frequency divide error = 0 ppm
OUTPUTTABLE
CPU
CLKREQ
SRC
HTT66
PCI
TURBO
USB48
24_48
REF
RESET#
2
8
1
113
1
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