參數(shù)資料
型號： IDTCV149PA
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 13/17頁
文件大小： 0K
描述： IC FLEXPC CLK PROGR K8 56-TSSOP
標準包裝： 35
系列： FlexPC™
類型： PC 時鐘
PLL： 是
主要目的： AMD CPU
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:21
差分 - 輸入:輸出： 無/是
頻率 - 最大： 400MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 56-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 56-TSSOP
包裝： 管件
其它名稱： CV149PA
COMMERCIALTEMPERATURERANGE
IDTCV149
PROGRAMMABLEFLEXPCCLOCKFORAMDK8PROCESSORATIRS480
5
BYTE 0
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
SRCT7, SRCC7
Outputenable
Tristate
Enable
RW
1
6
SRCT6, SRCC6
Outputenable
Tristate
Enable
RW
1
5
SRCT5, SRCC5
Outputenable
Tristate
Enable
RW
1
4
SRCT4, SRCC4
Outputenable
Tristate
Enable
RW
1
3
SRCT3, SRCC3
Outputenable
Tristate
Enable
RW
1
2
SRCT2, SRCC2
Outputenable
Tristate
Enable
RW
1
SRCT1, SRCC1
Outputenable
Tristate
Enable
RW
1
0
SRCT0, SRCT0
Outputenable
Tristate
Enable
RW
1
BYTE 2
Bit
Output(s)Affected
Description / Function
0
1
Type
Power On
7
PCI0
Outputenable
Tristate
Enable
RW
1
6
Reserved
RW
0
5
PCI0 SEL1
see PCI select table
RW
0
4
PCI0 SEL0
RW
0
3
Reserved
RW
0
2
SRCs
SRCT PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
1
CPUT1
CPUT1 PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
CPUT0
CPUT0 PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
BYTE 1
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
USB48
Outputenable
Tristate
Enable
RW
1
6
REF2
Outputenable
Tristate
Enable
RW
1
5
REF1
Outputenable
Tristate
Enable
RW
1
4
REF0
Outputenable
Tristate
Enable
RW
1
3
24_48MHz
Outputenable
Tristate
Enable
RW
1
2
CPUT1, CPUC1
Outputenable
Tristate
Enable
RW
1
CPUT0, CPUC0
Outputenable
Tristate
Enable
RW
1
0
HTT66
Outputenable
Tristate
Enable
RW
1
BYTE 3
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
7
SRC7
CLKREQ0#
CLKREQ1#
RW
0
6
SRC6
CLKREQ0#
CLKREQ1#
RW
0
5
SRC5
Controlled by CLKREQB#
CLKREQ0#
CLKREQ1#
RW
0
4
SRC4
or CLKREQA#
CLKREQ0#
CLKREQ1#
RW
0
3
SRC3
CLKREQ0#
CLKREQ1#
RW
0
2
Reserved
RW
0
1
Reserved
RW
0
SRC0
Controlled by CLKREQB#
CLKREQ0#
CLKREQ1#
RW
0
or CLKREQA#
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PDF描述
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