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參數(shù)資料
| 型號： | IDTV105ADAG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XMITTER LVDS DUAL 144-TQFP |
| 標準包裝： | 60 |
| 類型： | 發(fā)射器 |
| 規(guī)程： | LVDS |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-TQFP（20x20） |
| 包裝： | 托盤 |
| 其它名稱： | V105ADAG |
DATASHEET
ADVANCE INFORMATION
DUAL-CHANNEL,TRIPLE 10-BIT LVDS TRANSMITTER
1
IDTV105A
CONFIDENTIAL
CONFIDENTIAL
General Description
The V105A LVDS display interface transmitter is designed
to support pixel data transmission between a video
processing engine and a digital video display. The dual
channel LVDS output supports pixel rates up to 150 MHz,
enabling compatibility with 1080p and WUXGA display
resolutions.
Total 67-bit LVCMOS/LVTTL input is provided. The V105A
converts the 67 bit parallel input data into two 5-pair LVDS
(Low Voltage Differential Signaling) serial data outputs, in
odd/even pixel format. Input data can be clocked on the
rising or falling edge of the input clock (selectable). In video
applications the 35 data bits are normally divided into 10
bits for each R, G and B channel and 5 control bits (which
includes VSYNC, HSYNC and DE).
Features
Dual 32+3-bit LVTTL input supports up to 150 MHz pixel
rate.
Dual pixel, LVDS output supports 150 MHz pixel rate
(compatible with 1080p and WUXGA resolution)
Internal PLL requires no external loop filter
Selectable rising or falling clock edge for data alignment
Compatible with Spread Spectrum clock source
Reduced LVDS output voltage swing mode (selectable)
to minimize EMI
Single 3.3 V supply
Low power consumption CMOS design
Power down mode
Available in 144 pin LQFP package (14x14mm body size)
Block Diagram
Data
Serializer
35
TXA1+
TXA1-
TXB1+
TXB1-
TXC1+
TXC1-
TXD1+
TXD1-
TXE1+
TXE1-
TTL Input
Data latch,
Bit Mapper,
Demux
Data
Serializer
TA1[9:0]
TB1[9:0]
TC1[9:0]
RES1[2:1]
TA2[9:0]
TB2[9:0]
TC2[9:0]
RES2[2:1]
HSYNC
VSYNC
DE
CTRL
MAP
R/F
RS
PD
TEST
CLKIN
PLL and
Device Timing
10
2
10
2
3
35
TXD2+
TXD2-
TXE2+
TXE2-
TXA2+
TXA2-
TXB2+
TXB2-
TXC2+
TXC2-
TCLK1+
TCLK1-
TCLK2+
TCLK2-
DUAL-CHANNEL,TRIPLE 10-BIT LVDS TRANSMITTER
IDTV105A
7121/3
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參數(shù)描述 |
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