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參數(shù)資料
| 型號： | IDTV105ADAG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 13/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XMITTER LVDS DUAL 144-TQFP |
| 標準包裝： | 60 |
| 類型： | 發(fā)射器 |
| 規(guī)程： | LVDS |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-TQFP（20x20） |
| 包裝： | 托盤 |
| 其它名稱： | V105ADAG |
IDTV105A
DUAL-CHANNEL,TRIPLE 10-BIT LVDS TRANSMITTER
COMMERCIAL TEMPERATURE RANGE
DUAL-CHANNEL,TRIPLE 10-BIT LVDS TRANSMITTER
3
IDTV105A
7121/3
CONFIDENTIAL
Pin Descriptions
Pin Number
Pin Name
Pin Type
Pin Description
70, 71
TXA1+, TXA1-
LVDS OUT
LVDS Serial Data Output Pairs, Channel 1
68, 69
TXB1+, TXB1-
64, 65
TXC1+, TXC1-
58, 59
TXD1+, TXD1-
56, 57
TXE1+, TXE1-
52, 53
TXA2+, TXA2-
LVDS Serial Data Output Pairs, Channel 2
50,51
TXB2+, TXB2-
46, 47
TXC2+, TXC2-
40, 41
TXD2+, TXD2-
38,39
TXE2+, TXE2-
62, 63
TCLK1+, TCLK1-
LVDS OUT
LVDS Reference Clock Output Pair
44, 45
TCLK2+, TCLK2-
76, 77, 78, 79, 80,
81, 84, 85, 86, 87
TA10 ~TA19
IN
CMOS/TTL (or small signal) Data Bit Inputs, Channel 1
88, 89, 90, 91, 92,
95, 96, 97, 98, 99
TB10 ~ TB19
100, 101, 102, 103,
106, 107, 108, 110,
111, 112
TC10 ~TC19
17, 18
RES11, RES12
IN
Control Input, Channel 1
115, 116,117, 118,
119, 120, 121, 122,
123, 124
TA20 ~ TA29
IN
CMOS/TTL (or small signal) Data Bit Inputs, Channel 2
127, 128, 129, 130,
131, 132, 133, 134,
135, 136
TB20 ~ TB29
139, 140, 141, 142,
143, 144, 1, 2, 5, 6
TC20 ~ TC29
19, 20
RES21, RES22
IN
Control Input, Channel 2
7
HSYNC
IN
HSYNC InputI
8
VSYNC
IN
VSYNC Input
9DE
IN
DE Input
25, 26, 27
CTRL0 ~ CTRL2
IN
MODE Selection
24
MAP
IN
MAP MODE Selection
30
PD
IN
High: Normal device operation Low: Power down; all
outputs become high impedance
31
TEST
IN
Reserved: tie to High or Low
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PDF描述 |
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