參數資料
型號: IF280C52EXXX-L16SHXXX
廠商: TEMIC SEMICONDUCTORS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP44
文件頁數: 201/210頁
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代理商: IF280C52EXXX-L16SHXXX
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90
8048C–AVR–02/12
ATtiny43U
OCRnA changes its value from MAX, like in Figure 12-7 on page 89. When the OCRnA value
is MAX the OCn pin value is the same as the result of a down-counting Compare Match. To
ensure symmetry around BOTTOM the OCn value at MAX must correspond to the result of
an up-counting Compare Match.
The timer starts counting from a value higher than the one in OCRnA, and for that reason
misses the Compare Match and hence the OCn change that would have happened on the
way up.
12.8
Timer/Counter Timing Diagrams
The Timer/Counter is a synchronous design and the timer clock (clk
Tn) is therefore shown as a
clock enable signal in the following figures. The figures include information on when Interrupt
Flags are set. Figure 12-8 on page 90 contains timing data for basic Timer/Counter operation.
The figure shows the count sequence close to the MAX value in all modes other than phase cor-
rect PWM mode.
Figure 12-8. Timer/Counter Timing Diagram, no Prescaling
Figure 12-9 on page 90 shows the same timing data, but with the prescaler enabled.
Figure 12-9. Timer/Counter Timing Diagram, with Prescaler (f
clk_I/O/8)
Figure 12-10 on page 91 shows the setting of OCFnB in all modes and OCFnA in all modes
except CTC mode and PWM mode, where OCRnA is TOP.
clk
Tn
(clk
I/O/1)
TOVn
clk
I/O
TCNTn
MAX - 1
MAX
BOTTOM
BOTTOM + 1
TOVn
TCNTn
MAX - 1
MAX
BOTTOM
BOTTOM + 1
clk
I/O
clk
Tn
(clk
I/O/8)
相關PDF資料
PDF描述
MD80C32-30 8-BIT, 30 MHz, MICROCONTROLLER, CDIP40
MD87C51FB-16 8-BIT, UVPROM, 16 MHz, MICROCONTROLLER, CDIP40
MR87C51FB-16 8-BIT, UVPROM, 16 MHz, MICROCONTROLLER, CQCC44
MD87C51FB 8-BIT, UVPROM, MICROCONTROLLER, CDIP40
MZ87C51FB 8-BIT, UVPROM, MICROCONTROLLER, CQCC44
相關代理商/技術參數
參數描述
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IF280C52T-16 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
IF280C52T-20 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
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