參數(shù)資料
型號(hào)： ISL59118IRUZ-EVALZ
廠商： Intersil
文件頁數(shù)： 4/10頁
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描述： EVAL BOARD FOR ISL59118IRUZ
標(biāo)準(zhǔn)包裝： 1
系列： *
3
FN6317.2
September 22, 2006
Connection Diagram
dG
Differential Gain
NTSC and PAL
0.10
%
dP
Differential Phase
NTSC and PAL
0.5
°
D/DT
Group Delay Variation
f = 100kHz, 5MHz
5.4
ns
SNR
Signal To Noise Ratio
100% white signal
65
dB
tON
Enable Time
VIN = 500mV, VOUT to 1%
200
ns
tOFF
Disable Time
VIN = 500mV, VOUT to 1%
14
ns
+SR
Positive Slew Rate
10% to 90%, VIN = 1V step
30
40
50
V/s
-SR
Negative Slew Rate
90% to 10%, VIN = 1V step
-30
-40
-50
V/s
tF
Fall Time
2.5VSTEP, 80% - 20%
25
ns
tR
Rise Time
2.5VSTEP, 20% - 80%
22
ns
Electrical Specifications
VDD = 3.3V, TA = +25°C, RL = 150 to GND, unless otherwise specified. (Continued)
PARAMETER
DESCRIPTION
CONDITIONS
MIN
TYP
MAX
UNIT
75
x2
EN2
IN2
OUT2
x2
+
-
9MHz
EN1
Biasing &
Control
1uA
+
-
1uA
+
-
65mV
+
-
65mV
CVBS1
CVBS2
3.3V
VDD
0.1uF
uC or tie to 3.3V
0.1uF
75
IN1
OUT1
CVBS1
CVBS2
ISL59118
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PDF描述
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參數(shù)描述
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