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參數(shù)資料
| 型號： | K4C89183AF-GCFB |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 288Mb x18 Network-DRAM2 Specification |
| 中文描述： | 288Mb x18網絡DRAM2規(guī)范 |
| 文件頁數(shù)： | 18/55頁 |
| 文件大?。?/td> | 1470K |
| 代理商： | K4C89183AF-GCFB |
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K4C89183AF
- 18 -
REV. 0.7 Jan. 2005
t
DSPSTH
LAL
(after RDA)
t
IS
t
IH
t
CH
t
CL
t
CK
CK
CK
Input
(Control &
Addresses)
Write Timing (Burst Length = 4)
Unidirectional DS/QS mode, Unidirectional DS/Free Running QS mode
DESL
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
Q0
t
DSP
t
DQSS
t
DSP
t
DSP
t
DSS
t
DH
Q1
Q2
Q3
t
DSPRES
t
DSPREH
t
DSPST
t
DSS
t
DSPSTH
Postamble
Preamble
t
DSPRE
t
DS
t
DS
t
DH
t
DQSS
t
DH
t
DS
CAS latency = 4
LDS/UDS
(Input)
DQ
(Input)
Q0
t
DSP
t
DSP
t
DSP
t
DH
Q1
Q2
Q3
t
DSPRES
t
DSPREH
t
DSPST
t
DSS
Postamble
Preamble
t
DSPRE
DS
t
DS
t
DH
t
DH
t
DS
CAS latency = 5
LDS/UDS
(Input)
DQ
(Input)
t
DSS
LQS/UQS
(Uni-QS)
LQS/UQS
(Free Runninig)
Low
Note : DQ0 to DQ17 are sampled at both edges of LDS.
DQ18 to DQ35 are sampled at both edges of UDS.
t
DSPSTH
t
DQSS
Q0
t
DSP
t
DSP
t
DSP
t
DH
Q1
Q2
Q3
t
DSPRES
t
DSPREH
t
DSPST
t
DSS
Postamble
Preamble
t
DSPRE
t
DS
t
DS
t
DH
t
DH
t
DS
CAS latency = 6
LDS/UDS
(Input)
DQ
(Input)
t
DSS
相關PDF資料 |
PDF描述 |
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