KS8695PX Micrel System Clock The clock to the KS8695PX is supplied by either a 25MHz ±50ppm crystal or by" />
參數(shù)資料
型號(hào)： KS8695PX
廠商： Micrel Inc
文件頁數(shù)： 11/40頁
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描述： IC SWITCH 10/100 1PORT 289PBGA
標(biāo)準(zhǔn)包裝： 84
類型： 網(wǎng)關(guān)
應(yīng)用： 網(wǎng)絡(luò)和通信
安裝類型： 表面貼裝
封裝/外殼： 289-PBGA
供應(yīng)商設(shè)備封裝： 289-PBGA（19x19）
包裝： 管件
配用： KS8695-EVAL-ND - EVAL KIT EXPERIMENTAL KS8695
576-1004-ND - BOARD EVAL EXPERIMENT KS8695PX
September 2005
19
M9999-091605
KS8695PX
Micrel
System Clock
The clock to the KS8695PX is supplied by either a 25MHz ±50ppm crystal or by an oscillator. If an oscillator is used, it must
be connected to the XCLK1 input (pin E1) on the KS8695PX. If a crystal is used, it must be connected with a circuit similar
to the one shown below. The 25MHz input clock is used by an internal PLL to generate the programmable SDOCLK. SDO-
CLK is the system clock and can be programmed from 25MHz to 125MHz using the system clock and bus control register
at offset 0x0004. The CPUCLKSEL strap-in option on pin M15 needs to be pulled low for normal operation. SDICLK is used
to register the data read from the SDRAM back into the KS8695PX. The system designer must ensure that SDRAM timing
is met when routing SDOCLK back to SDICLK.
25MHz
Xtal
22pF
XCLK1 XCLK2
E1
E2
SDOCLK
U7
To System
25MHz to 125MHz
URTSN/
CPUCLKSEL
M15
1k
KS8695P
T7
SDICLK
Figure 6. Typical Clock Circuit
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PDF描述
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