參數(shù)資料
型號： L64724
廠商： LSI Corporation
英文描述： Satellite Receiver(衛(wèi)星信號接收器（包含BPSK/QPSK 解調(diào)器和FEC解碼器）)
中文描述： 衛(wèi)星接收機（衛(wèi)星信號接收器（包含的BPSK / QPSK調(diào)制解調(diào)器和前向糾錯解碼器））
文件頁數(shù)： 258/294頁
文件大?。?/td> 3728K
代理商： L64724
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B-44
L64724 Application Notes
Set the bits in the Group 4, APR 62 register as shown in
Table B.13
.
Group 4, APR 63 –
Set to 0x63.
Clear the FMODE bit (D7) to 0. Set the SPI_CLK_AND bit (D6) to 1 to
AND the SPI byte clock and the data valid signal. Set SPI_MODE_A_B
to 0 for Mode A. Set SPI_N[3:0] to 3 since the Viterbi Code Rate is 3/4.
Group 4, APR 64
–
65 –
Set to 0x0008.
Set the SPI_GAIN[9:0] to 8 because the oversampling ratio (OR) is 30.
Set Group 4, APR 65 to 0x08 and APR 64 to 0x00.
Group 4, APR 66
–
68 –
Set to 0x066666.
Set the SPI_Bias[22:0] value as shown in
Equation B.65
.
Equation B.65
Table B.13
Group 4, APR 62 Register Bits
Bits
Setting
Acronym
Meaning
D7
–
Serial_B
Refer to
Appendix C, Programming the
Serializer
, for more details.
D6 to D5
–
Serial_C[1:0]
Refer to
Appendix C, Programming the
Serializer
, for more details.
D4 to D1
0b0100
SPI_M[3:0]
Denominator of Viterbi Code Rate = 4
(rate = 3/4)
D0
–
Serial_A
Refer to
Appendix C, Programming the
Serializer
, for more details.
OR
SPI Gain
2 to 4
50.0
4 to 8
35.0
8 to 16
15.0
Greater than 16
less than 10
SPIBias
24
--------------------------
=
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PDF描述
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L64730GM-20 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Image Processor
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