參數(shù)資料
型號(hào)： L7C174KMB25
廠商： LOGIC DEVICES INC
元件分類： SRAM
英文描述： 8K X 8 CACHE TAG SRAM, 22 ns, CQCC32
封裝： CERAMIC, LCC-32
文件頁數(shù)： 5/8頁
文件大?。?/td> 60K
代理商： L7C174KMB25
DEVICES INCORPORATED
L7C174
8K x 8 Cache-Tag Static RAM
03/26/1999–LDS.174-M
5
Special Architecture Static RAMs
DATA-IN VALID
HIGH IMPEDANCE
ADDRESS
DATA OUT
DATA IN
CE
WE
tWLQZ
tDVEW
tEWDX
tWHQZ
tEWAX
tWLEW
tAVEW
tCLEW
tAVBW
tAVAV
SWITCHING CHARACTERISTICS Over Operating Range
L7C174–
35
25
20
15
12
Symbol
Parameter
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
tAVAV
Write Cycle Time
25
20
15
12
tCLEW
Chip Enable Low to End of Write Cycle
25
15
12
10
tAVBW
Address Valid to Beginning of Write Cycle
0
tAVEW
Address Valid to End of Write Cycle
25
15
12
10
tEWAX
End of Write Cycle to Address Change
0
tWLEW
Write Enable Low to End of Write Cycle
20
15
12
10
tDVEW
Data Valid to End of Write Cycle
15
10
7
6
tEWDX
End of Write Cycle to Data Change
0
tWHQZ
Write Enable High to Output Low Z (Notes 20, 21)
000
00
tWLQZ
Write Enable Low to Output High Z (Notes 20, 21)
10
77
54
WRITE CYCLE Notes 5, 11, 12, 22, 23, 24 (ns)
WRITE CYCLE — WE CONTROLLED Notes 16, 17, 18
WRITE CYCLE — CE CONTROLLED Notes 16, 17, 18
DATA-IN VALID
ADDRESS
DATA IN
HIGH IMPEDANCE
tAVBW
WE
tAVAV
tCLEW
tAVEW
tWLEW
tDVEW
tEWDX
tEWAX
CE
DATA OUT
OBSOLETE
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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