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參數(shù)資料
| 型號(hào)： | LC5256MV-4FN256C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁(yè)數(shù)： | 36/99頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CPLD 256MACROCELLS 256FPBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | ispXPLD® 5000MV |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 4.0ns |
| 電壓電源 - 內(nèi)部： | 3 V ~ 3.6 V |
| 邏輯元件/邏輯塊數(shù)目： | 8 |
| 宏單元數(shù)： | 256 |
| 輸入/輸出數(shù)： | 141 |
| 工作溫度： | 0°C ~ 90°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應(yīng)商設(shè)備封裝： | 256-FPBGA（17x17） |
| 包裝： | 托盤 |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
37
tSPADDH
Address Hold time
after Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPRWS
R/W Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.27
—
-0.27
—
-0.21
—
ns
tSPRWH
R/W Hold time after
Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPDATAS
Data Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.27
—
-0.27
—
-0.21
—
ns
tSPDATAH
Data Hold time after
Clock Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tSPCLKO
Clock to Output
Delay
—
5.97
—
5.97
—
5.97
—
5.97
—
9.86
ns
tSPRSTO
Reset to RAM
Output Delay
—
3.30
—
3.30
—
3.30
—
3.30
—
4.29
ns
tSPRSTR
Reset Recovery
Time
—
1.20
—
1.20
—
1.20
—
1.20
—
1.56
—
ns
tSPRSTPW
Reset Pulse Width
—
0.14
—
0.14
—
0.14
—
0.14
—
0.19
—
ns
Pseudo Dual Port RAM
tPDPMSS
Memory Select
Setup Before Clock
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPMSH
Memory Select
Hold time after
Clock
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPRCES
Clock Enable Setup
before Read Clock
Time
—
2.33
—
2.33
—
2.91
—
2.91
—
3.03
—
ns
tPDPRCEH
Clock Enable Hold
time after Read
Clock Time
—
-2.95
—
-2.95
—
-2.36
—
-2.36
—
-2.27
—
ns
tPDPWCES
Clock Enable Setup
before Write Clock
Time
—
1.87
—
1.87
—
2.34
—
2.34
—
2.43
—
ns
tPDPWCEH
Clock Enable Hold
time after Write
Clock Time
—
-2.95
—
-2.95
—
-2.36
—
-2.36
—
-2.27
—
ns
tPDPRADDS
Read Address
Setup before Read
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPRADDH
Read Address Hold
after Read Clock
Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPWADDS
Write Address
Setup before Write
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
tPDPWADDH
Write Address Hold
after Write Clock
Time
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
-0.01
—
ns
tPDPRWS
R/W Setup before
Clock Time
—
-0.27
—
-0.27
—
-0.22
—
-0.22
—
-0.21
—
ns
ispXPLD 5000MX Family Internal Switching Characteristics (Continued)
Over Recommended Operating Conditions
Parameter
Description
Base
Parameter
-4
-45
-5
-52
-75
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
SELECT
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DISCONTINUED
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