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參數(shù)資料
| 型號： | LC87F2932AU-CD-E |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 13/29頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 32K FLASH 64TQLP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 芯體尺寸： | 8-位 |
| 速度： | 12MHz |
| 連通性： | SIO，UART/USART |
| 外圍設(shè)備： | PWM，WDT |
| 輸入/輸出數(shù)： | 59 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.2 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 13x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | * |
| 包裝： | * |
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LC87F2932A
No.A1210-20/29
Serial Input/Output Characteristics at Ta = -40°C to +85°C, VSS1 = VSS2 = VSS3 = 0V
1. SIO0 Serial I/O Characteristics (Note 4-1-1)
Parameter
Symbol
Pin/Remarks
Conditions
Specification
VDD[V]
min
typ
max
unit
Serial
c
lock
Inpu
tclo
ck
Frequency
tSCK(1)
SCK0(P12)
See Fig. 6.
2.2 to 5.5
2
tCYC
Low level
pulse width
tSCKL(1)
1
High level
pulse width
tSCKH(1)
1
tSCKHA(1)
Continuous data
transmission/reception mode
See Fig. 6.
(Note 4-1-2)
4
Out
put
c
lock
Frequency
tSCK(2)
SCK0(P12)
CMOS output selected
See Fig. 6.
2.2 to 5.5
4/3
Low level
pulse width
tSCKL(2)
1/2
tSCK
High level
pulse width
tSCKH(2)
1/2
tSCKHA(2)
Continuous data
transmission/reception mode
CMOS output selected
See Fig. 6.
tSCKH(2)
+2tCYC
tSCKH(2)
+(10/3)
tCYC
Serial
input
Data setup time
tsDI(1)
SB0(P11),
SI0(P11)
Must be specified with
respect to rising edge of
SIOCLK.
See Fig. 6.
2.2 to 5.5
0.03
μs
Data hold time
thDI(1)
2.2 to 5.5
0.03
S
er
ia
lou
tp
ut
Inpu
tclo
ck
Output delay
time
tdD0(1)
SO0(P10),
SB0(P11)
Continuous data
transmission/reception mode
(Note 4-1-3)
2.2 to 5.5
(1/3)tCYC
+0.05
tdD0(2)
Synchronous 8-bit mode
(Note 4-1-3)
2.2 to 5.5
1tCYC
+0.05
Out
put
c
lock
tdD0(3)
(Note 4-1-3)
2.2 to 5.5
(1/3)tCYC
+0.15
Note 4-1-1: These specifications are theoretical values. Add margin depending on its use.
Note 4-1-2: To use serial-clock-input in continuous trans/rec mode, a time from SI0RUN being set when serial clock
is "H" to the first negative edge of the serial clock must be longer than tSCKHA.
Note 4-1-3: Must be specified with respect to falling edge of SIOCLK. Must be specified as the time to the beginning
of output state change in open drain output mode. See Fig. 6.
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PDF描述 |
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