LatticeECP/EC Family Timing Adders1, 2, " />
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    參數(shù)資料
    型號： LFEC1E-3QN208I
    廠商： Lattice Semiconductor Corporation
    文件頁數(shù)： 117/163頁
    文件大?。?/td> 0K
    描述： IC FPGA 1.5KLUTS 208PQFP
    標(biāo)準(zhǔn)包裝： 48
    系列： EC
    邏輯元件/單元數(shù)： 1500
    RAM 位總計： 18432
    輸入/輸出數(shù)： 112
    電源電壓： 1.14 V ~ 1.26 V
    安裝類型： 表面貼裝
    工作溫度： -40°C ~ 100°C
    封裝/外殼： 208-BFQFP
    供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
    3-21
    DC and Switching Characteristics
    LatticeECP/EC Family Data Sheet
    LatticeECP/EC Family Timing Adders1, 2, 3
    Over Recommended Operating Conditions
    Buffer Type
    Description
    -5
    -4
    -3
    Units
    Input Adjusters
    LVDS25
    LVDS
    0.41
    0.50
    0.58
    ns
    BLVDS25
    BLVDS
    0.41
    0.50
    0.58
    ns
    LVPECL33
    LVPECL
    0.50
    0.60
    0.70
    ns
    HSTL18_I
    HSTL_18 class I
    0.41
    0.49
    0.57
    ns
    HSTL18_II
    HSTL_18 class II
    0.41
    0.49
    0.57
    ns
    HSTL18_III
    HSTL_18 class III
    0.41
    0.49
    0.57
    ns
    HSTL18D_I
    Differential HSTL 18 class I
    0.37
    0.44
    0.52
    ns
    HSTL18D_II
    Differential HSTL 18 class II
    0.37
    0.44
    0.52
    ns
    HSTL18D_III
    Differential HSTL 18 class III
    0.37
    0.44
    0.52
    ns
    HSTL15_I
    HSTL_15 class I
    0.40
    0.48
    0.56
    ns
    HSTL15_III
    HSTL_15 class III
    0.40
    0.48
    0.56
    ns
    HSTL15D_I
    Differential HSTL 15 class I
    0.37
    0.44
    0.51
    ns
    HSTL15D_III
    Differential HSTL 15 class III
    0.37
    0.44
    0.51
    ns
    SSTL33_I
    SSTL_3 class I
    0.46
    0.55
    0.64
    ns
    SSTL33_II
    SSTL_3 class II
    0.46
    0.55
    0.64
    ns
    SSTL33D_I
    Differential SSTL_3 class I
    0.39
    0.47
    0.55
    ns
    SSTL33D_II
    Differential SSTL_3 class II
    0.39
    0.47
    0.55
    ns
    SSTL25_I
    SSTL_2 class I
    0.43
    0.51
    0.60
    ns
    SSTL25_II
    SSTL_2 class II
    0.43
    0.51
    0.60
    ns
    SSTL25D_I
    Differential SSTL_2 class I
    0.38
    0.45
    0.53
    ns
    SSTL25D_II
    Differential SSTL_2 class II
    0.38
    0.45
    0.53
    ns
    SSTL18_I
    SSTL_18 class I
    0.40
    0.48
    0.56
    ns
    SSTL18D_I
    Differential SSTL_18 class I
    0.37
    0.44
    0.51
    ns
    LVTTL33
    LVTTL
    0.07
    0.09
    0.10
    ns
    LVCMOS33
    LVCMOS 3.3
    0.07
    0.09
    0.10
    ns
    LVCMOS25
    LVCMOS 2.5
    0.00
    ns
    LVCMOS18
    LVCMOS 1.8
    0.07
    0.09
    0.10
    ns
    LVCMOS15
    LVCMOS 1.5
    0.24
    0.29
    0.33
    ns
    LVCMOS12
    LVCMOS 1.2
    1.27
    1.52
    1.77
    ns
    PCI33
    PCI
    0.07
    0.09
    0.10
    ns
    Output Adjusters
    LVDS25E
    LVDS 2.5 E
    0.12
    0.14
    0.17
    ns
    LVDS25
    LVDS 2.5
    -0.44
    -0.53
    -0.62
    ns
    BLVDS25
    BLVDS 2.5
    0.33
    0.40
    0.46
    ns
    LVPECL33
    LVPECL 3.3
    0.20
    0.24
    0.28
    ns
    HSTL18_I
    HSTL_18 class I
    -0.10
    -0.12
    -0.14
    ns
    HSTL18_II
    HSTL_18 class II
    0.06
    0.07
    0.08
    ns
    HSTL18_III
    HSTL_18 class III
    0.15
    0.19
    0.22
    ns
    HSTL18D_I
    Differential HSTL 18 class I
    -0.10
    -0.12
    -0.14
    ns
    HSTL18D_II
    Differential HSTL 18 class II
    0.06
    0.07
    0.08
    ns
    HSTL18D_III
    Differential HSTL 18 class III
    0.15
    0.19
    0.22
    ns
    HSTL15_I
    HSTL_15 class I
    0.08
    0.10
    0.11
    ns
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