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參數(shù)資料
| 型號(hào)： | LFECP33E-5FN672C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 124/163頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 32.8KLUTS 672FPBGA |
| 產(chǎn)品培訓(xùn)模塊： | LatticeECP3 Introduction |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | ECP |
| 邏輯元件/單元數(shù)： | 32800 |
| RAM 位總計(jì)： | 434176 |
| 輸入/輸出數(shù)： | 496 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 672-BBGA |
| 供應(yīng)商設(shè)備封裝： | 672-FPBGA（27x27） |
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3-27
DC and Switching Characteristics
LatticeECP/EC Family Data Sheet
Figure 3-14. sysCONFIG Master Serial Port Timing
Figure 3-15. sysCONFIG Slave Serial Port Timing
Figure 3-16. Power-On-Reset (POR) Timing
CCLK (output)
DIN
DOUT
t
SUMCDI
t
HMCDI
t
CODO
CCLK (input)
DIN
DOUT
t
SUSCDI
t
HSCDI
t
CODO
t
SSCL
t
SSCH
CCLK
2
DONE
VCC/VCCAUX
1
CFG[2:0]
3
t
ICFG
Valid
INITN
t
VMC
t
SUCFG
t
HCFG
1. Time taken from VCC or VCCAUX, whichever is the last to reach its VMIN.
2. Device is in a Master Mode.
3. The CFG pins are normally static (hard wired).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 93LC56BT-I/OT | IC EEPROM 2KBIT 3MHZ SOT23-6 |
| 24LC04BT-I/OT | IC EEPROM 4KBIT 400KHZ SOT23-5 |
| 93C46BT/SN | IC EEPROM 1KBIT 2MHZ 8SOIC |
| AMM25DSEI-S243 | CONN EDGECARD 50POS .156 EYELET |
| HCC65DRXS-S734 | CONN EDGECARD 130PS DIP .100 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LFECP33E-5FN672I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFECP33E-5Q208C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFECP33E-5Q208I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFECP33E-5QN208C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFECP33E-5QN208I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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