參數(shù)資料
型號(hào)： LM9801CCVF
廠商： NATIONAL SEMICONDUCTOR CORP
元件分類(lèi)： 模擬信號(hào)調(diào)理
英文描述： Greyscale/24-Bit Color Linear CCD Sensor Processor
中文描述： SPECIALTY ANALOG CIRCUIT, PQFP52
封裝： TQFP-52
文件頁(yè)數(shù)： 15/34頁(yè)
文件大小： 520K
代理商： LM9801CCVF
TABLE I. Configuration Register Address Table
A2
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
0
0
0
Standard
Mode or
Even/Odd
Mode
Width
Pulse
RS
Polarity
Pulse
RS
RS Pulse Position
MODE
RSW1
RSW0
RSPOL
RSPOS3
RSPOS2
RSPOS1
RSPOS0
0
0
1
Sample Reference Position
(Maximum Register Value is 14)
Sample Signal Position
SR3
SR2
SR1
SR0
SS3
SS2
SS1
SS0
w
1
w
2
RS
TR
TR Pulse Width
TR–
w
1
Guardband
TR
0
1
0
Enable
Enable
Enable
Enable
Polarity
w
1EN
w
2EN
RSEN
TREN
TRW1
TRW0
TRGRD
TRPOL
0
1
1
Signal
Polarity
Dummy Pixels (Minimum Register Value is 2)
SIGPOL
BLS6
BLS5
BLS4
BLS3
BLS2
BLS1
BLS0
1
0
0
Optical Black Pixels (Minimum Register Value is 1)
BLL7
BLL6
BLL5
BLL4
BLL3
BLL2
BLL1
BLL0
1
0
1
PGA Gain Coefficient
GAIN7
GAIN6
GAIN5
GAIN4
GAIN3
GAIN2
GAIN1
GAIN0
PGA Gain
Source
Offset DAC
Sign
Power-
down
Offset
Add
VGA Gain
MSB
VGA
Gain
VGA
Gain
VGA Gain
LSB
1
1
0
PGASRC
ODSIGN
PD
OFFADD
VGA3
VGA2
VGA1
VGA0
Offset DAC
MSB
Offset DAC
Offset DAC
Offset DAC
LSB
Test Modes
1
1
1
VOS3
VOS2
VOS1
VOS0
0
0
0
0
TABLE II. Configuration Register Parameters
Parameter
Control Bits
Result
MODE
MODE
0
1
Standard CCD (
w
frequency
e
f
MCLK
/8)
Even/Odd CCD (
w
frequency
e
f
MCLK
/16)
RS Pulse Width
(t
RSWIDTH
)
RS1
RS0
0
0
1
1
0
1
0
1
1 t
MCLK
(50 ns)
2 t
MCLK
(100 ns)
3 t
MCLK
(150 ns)
4 t
MCLK
(200 ns)
RS Pulse Polarity
RSPOL
0
1
RS
RS
Note:
t
MCLK
e
1/f
MCLK
e
1 MCLK period. Examples given in parenthesis are for f
MCLK
e
20 MHz (t
MCLK
e
50 ns).
http://www.national.com
15
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