參數(shù)資料
型號： LM9811CCV
廠商： NATIONAL SEMICONDUCTOR CORP
元件分類： 模擬信號調(diào)理
英文描述： 10-Bit Greyscale/30-Bit Color Linear CCD Sensor Processor
中文描述： SPECIALTY ANALOG CIRCUIT, PQCC52
封裝： PLASTIC, LCC-52
文件頁數(shù)： 15/36頁
文件大?。?/td> 605K
代理商： LM9811CCV
Configuration Register
t
= 1/f
= 1 MCLK period. Examples given in parenthesis are for f
MCLK
=
20MHz (t
MCLK
= 50ns). Times for 12MHz MCLK can be calculated by multiplying by
TABLE 1. Configuration Register Address Table
A2
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
0
0
0
Standard
Mode or
Even/Odd
Mode
MODE
RS
Pulse
Width
RS
Pulse
Polarity
RS Pulse Position
RSW1
RSW0
RSPOL
RSPOS3
RSPOS2
RSPOS1
RSPOS0
0
0
1
Sample Reference Position
(Maximum Register Value is 14)
SR2
φ
2
Enable
φ
2EN
Sample Signal Position
SR3
φ
1
Enable
φ
1EN
Signal
Polarity
SIGPOL
SR1
RS
Enable
RSEN
SR0
TR
Enable
TREN
SS3
SS2
SS1
TR–
φ
1
Guardband
TRGRD
SS0
TR
Polarity
TRPOL
0
1
0
TR Pulse Width
TRW1
TRW0
0
1
1
Dummy Pixels (Minimum Register Value is 2)
BLS6
BLS5
Optical Black Pixels (Minimum Register Value is 1)
BLL5
BLL4
PGA Gain Coefficient
GAIN5
GAIN4
BLS4
BLS3
BLS2
BLS1
BLS0
1
0
0
BLL7
BLL6
BLL3
BLL2
BLL1
BLL0
1
0
1
GAIN7
GAIN6
Offset
DAC
Sign
ODSIGN
GAIN3
GAIN2
GAIN1
GAIN0
1
1
0
PGA Gain
Source
Power-
down
Offset
Add
VGA Gain
MSB
VGA
Gain
VGA
Gain
VGA Gain
LSB
PGASRC
Offset
DAC
MSB
VOS3
PD
OFFADD
Offset
DAC
LSB
VOS0
VGA3
VGA2
VGA1
VGA0
1
1
1
Offset
DAC
Offset
DAC
Test Modes
VOS2
VOS1
0
0
0
0
TABLE 2. Configuration Register Parameters
Parameter
Control Bits
Result
MODE
MODE
0
1
RS1
0
0
1
1
Standard CCD (
φ
frequency = f
MCLK
/8)
Even/Odd CCD (
φ
frequency = f
MCLK
/16)
RS Pulse Width
(t
RSWIDTH
)
RS0
0
1
0
1
1 t
MCLK
(50ns)
2 t
MCLK
(100ns)
3 t
MCLK
(150ns)
4 t
MCLK
(200ns)
RS Pulse Polarity
RSPOL
0
1
RS
RS
www.national.com
15
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