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參數(shù)資料
| 型號： | LTC1659IS8#PBF |
| 廠商： | Linear Technology |
| 文件頁數(shù)： | 9/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC D/A CONV 12BIT R-R 8-SOIC |
| 標(biāo)準(zhǔn)包裝： | 100 |
| 設(shè)置時間： | 14µs |
| 位數(shù)： | 12 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 單電源 |
| 功率耗散（最大）： | 720µW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOIC |
| 包裝： | 管件 |
| 輸出數(shù)目和類型： | 1 電壓，單極 |
| 采樣率（每秒）： | * |
| 產(chǎn)品目錄頁面： | 1350 (CN2011-ZH PDF) |
LTC1659
6
1659fa
PIN FUNCTIONS
BLOCK DIAGRAM
CLK (Pin 1): Serial Interface Clock. Internal Schmitt trigger
on this input allows direct optocoupler interface.
DIN (Pin 2): Serial Interface Data. Data on the DIN pin is
latched into the shift register on the rising edge of the
serial clock.
CS/LD (Pin 3): Serial Interface Enable and Load Control.
When
CS/LD is low the CLK signal is enabled, so the data
can be clocked in. When
CS/LDispulledhigh,dataisloaded
from the shift register into the DAC register, updating the
DAC output and the CLK is disabled internally.
DOUT (Pin 4): Output of the Shift Register which Becomes
Valid on the Rising Edge of the Serial Clock.
GND (Pin 5): Ground.
REF (Pin 6): Reference Input. This pin can be tied to VCC.
The output will swing from 0V to REF. The typical input
resistance is 28k.
VOUT (Pin 7): Buffered DAC Output.
VCC (Pin 8): Positive Supply Input. 2.7V ≤ VCC ≤ 5.5V.
Requires a bypass capacitor to ground.
DAC
REGISTER
LD
12-BIT
SHIFT
REGISTER
POWER-ON
RESET
1659 BD
CLK 1
DIN 2
DOUT 4
VOUT
7
REF
6
GND
5
VCC
8
3
CS/LD
12-BIT
DAC
+
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LTC1451CS8#PBF | IC D/A CONV 12BIT R-R 8-SOIC |
| AD5667BRMZ-REEL7 | IC DAC 16BIT I2C DL 10MSOP |
| VI-BNW-MV-F1 | CONVERTER MOD DC/DC 5.5V 150W |
| VI-J4K-MZ-F3 | CONVERTER MOD DC/DC 40V 25W |
| VI-BNV-MV-F4 | CONVERTER MOD DC/DC 5.8V 150W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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