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參數(shù)資料
| 型號： | M1A3P600-FGG484I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 13824 CLBS, 600000 GATES, PBGA484 |
| 封裝： | 23 X 23 MM, 2.23 MM HEIGHT, 1 MM PITCH, GREEN, FBGA-484 |
| 文件頁數(shù)： | 37/218頁 |
| 文件大小： | 6270K |
| 代理商： | M1A3P600-FGG484I |
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ProASIC3 DC and Switching Characteristics
v1.4
2 - 117
Advance v0.5
(continued)
Table 2-51 ProASIC3 Output Drive for Standard+ I/O Bank Type was updated.
2-84
Table 2-54 ProASIC3 Output Drive for Advanced I/O Bank Type was updated.
2-84
The "x" was updated in the "User I/O Naming Convention" section.
2-48
The "VCC Core Supply Voltage" pin description was updated.
2-50
The "VMVx I/O Supply Voltage (quiet)" pin description was updated to include
information concerning leaving the pin unconnected.
2-50
The "VJTAG JTAG Supply Voltage" pin description was updated.
2-50
The "VPUMP Programming Supply Voltage" pin description was updated to
include information on what happens when the pin is tied to ground.
2-50
The "I/O User Input/Output" pin description was updated to include information
on what happens when the pin is unused.
2-50
The "JTAG Pins" section was updated to include information on what happens
when the pin is unused.
2-51
The "Programming" section was updated to include information concerning
serialization.
2-53
The
"JTAG
1532"
section
was
updated
to
include
SAMPLE/PRELOAD
information.
2-54
"DC and Switching Characteristics" chapter was updated with new information.
3-1
Advance v0.3
M7 device information is new.
N/A
Table 2-4 ProASIC3 Globals/Spines/Rows by Device was updated to include the
number or rows in each top or bottom spine.
2-16
EXTFB was removed from Figure 2-24 ProASIC3E CCC Options.
2-24
The "PLL Macro" section was updated. EXTFB information was removed from
this section.
2-15
The CCC Output Peak-to-Peak Period Jitter FCCC_OUT was updated in Table 2-
11 ProASIC3 CCC/PLL Specification
2-29
EXTFB was removed from Figure 2-27 CCC/PLL Macro.
2-28
Table 2-13 ProASIC3 I/O Features was updated.
2-30
The "Hot-Swap Support" section was updated.
2-33
The "Cold-Sparing Support" section was updated.
2-34
"Electrostatic Discharge (ESD) Protection" section was updated.
2-35
The LVPECL specification in Table 2-43 I/O Hot-Swap and 5 V Input Tolerance
Capabilities in ProASIC3 Devices was updated.
2-64
In the Bank 1 area of Figure 2-72, VMV2 was changed to VMV1 and VCCIB2 was
changed to VCCIB1.
2-97
The VJTAG and I/O pin descriptions were updated in the "Pin Descriptions"
section.
2-50
The "JTAG Pins" section was updated.
2-51
"128-Bit AES Decryption" section was updated to include M7 device
information.
2-53
Table 3-6 was updated.
3-6
Previous Version
Changes in Current Version (v1.4)
Page
相關PDF資料 |
PDF描述 |
|---|---|
| M1A3P600-FGG484 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA484 |
| M1A3P600-PQ208I | FPGA, 13824 CLBS, 600000 GATES, PQFP208 |
| M1A3P600-PQ208 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PQFP208 |
| M1A3P600-PQG208I | FPGA, 13824 CLBS, 600000 GATES, PQFP208 |
| M1A3P600-PQG208 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PQFP208 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| M1A3P600-FPQ144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-FPQ144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-FPQ144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-FPQ208 | 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 600K GATES 193MHZ 130NM 1.5V 208PQFP - Trays |
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