參數(shù)資料
型號(hào): M1AFS250-FPQ208
元件分類: FPGA
英文描述: FPGA, 250000 GATES, PQFP208
封裝: 0.50 MM PITCH, PQFP-208
文件頁數(shù): 44/318頁
文件大小: 10129K
代理商: M1AFS250-FPQ208
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Device Architecture
2- 122
Pr el iminar y v1 .7
Examples
Calculating Accuracy for an Uncalibrated Analog Channel
Formula
For a given prescaler range,
Output Voltage = (Channel Output Offset in V) + (Input Voltage x Channel Gain)
where
Channel Output offset in V = Channel Output offset in LSBs x Equivalent voltage per LSB
Channel Gain Factor = 1+ (% Channel Gain / 100)
Example
Input Voltage = 5 V
Chosen Prescaler range = 8 V range
Max. Output Voltage = (Max Positive output offset) + (Input Voltage x Max Gain Factor)
Max. Positive output offset = (8 LSB) x (8mV per LSB in 10-bit mode)
Max. Positive output offset = 64 mV
Max. Gain = 1 + (2/100)
Max. Gain = 1.02
Max. Output Voltage = (64 mV) + (5 V x 1.02)
Max. Output Voltage = 5.164 V
Similarly,
Table 2-50 Analog Channel Accuracy: Monitoring Standard Positive Voltages
Typical Conditions, TA = 25°C
Input Voltage
(V)
Calibrated Typical Error per Positive Prescaler Setting 1 (%FSR)
Direct ADC 2,3
(%FSR)
16 V (AT)
16 V (12 V)
(AV/AC)
8 V
(AV/AC)
4 V (AT)
4 V
(AV/AC)
2 V
(AV/AC)
1 V
(AV/AC)
VAREF = 2.56 V
15
1
14
1
12
1
52
2
1
3.3
2
1
2.5
3
2
1
1.8
4
1
1.5
5
2
1
1.2
7
6
2
1
0.9
9
4
3
1
Notes:
1. Requires enabling Analog Calibration in the Actel tool flow.
2. Direct ADC mode using an external VAREF of 2.56V±4.6mV, without Analog Calibration macro.
3. For input greater than 2.56 V, the ADC output will saturate. A higher VAREF or prescaler usage is
recommended.
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PDF描述
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