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參數(shù)資料
| 型號： | M38D59FFHP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 6.25 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 87/142頁 |
| 文件大?。?/td> | 2004K |
| 代理商： | M38D59FFHP |
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Rev.3.04
May 20, 2008
REJ03B0158-0304
38D5 Group
[Serial I/O2 Operation]
Writing to the serial I/O2 register initializes the serial I/O2
counter to “7”.
After writing, the SOUT2 pin outputs data each time the
synchronous clock changes from “H” to “L”. The SIN2 pin
captures data each time the synchronous clock changes from “L”
to “H” and the serial I/O2 register shifts 1-bit simultaneously.
When the external clock is selected as the synchronous clock,
counting the synchronous clock eight times results the following:
Serial I/O2 counter = “0”
Synchronous clock is stopped at “H”
Serial I/O2 interrupt request bit = “1”
After transfer is completed, the SOUT2 pin is placed in the high-
impedance state.
When the external clock is selected as the synchronous clock,
counting the synchronous clock eight times sets the serial I/O2
bit to “1” and the SOUT2 pin retains the D7 output level.
However, if the synchronous clock is continuously input, the
serial I/O2 register continues shifting and the SOUT2 pin keeps
outputting transmit data.
Fig. 40 Serial I/O2 timing
D0
D1
D2
D3
D4
D5
D6
Serial I/O2 interrupt request bit set
Transfer clock
Serial I/O2 register
write signal
Serial I/O2 input SIN2
Notes 1: When the internal clock is selected as the transfer, the dividing frequency of internal clock for transfer
clock can be selected by bits 0 to 2 of serial I/O2 control register.
2: When the internal clock is selected as the synchronous clock, the SOUT2 pin is placed in the high
impedance state after transfer is completed.
3: When the external clock is selected as the synchronous clock, the SOUT2 pin retains the D7 output level
after transfer is completed.
However, if the synchronous clock is continuously input, the serial I/O2 register continues shifting and the
SOUT2 pin keeps outputting transmit data.
D7
Serial I/O2 output SOUT2
(1)
(2) (3)
Reception enable signal
SRDY2
(When the internal clock
is selected)
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PDF描述 |
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