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參數(shù)資料
型號： MAX19527EXE+
廠商： Maxim Integrated Products
文件頁數(shù)： 26/30頁
文件大?。?/td> 0K
描述： IC ADC 12BIT 8CH 50MSPS 144CTBGA
應(yīng)用說明： Ultrasound Imaging Systems Application Note
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 240
位數(shù)： 12
采樣率（每秒）： 50M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 8
功率耗散（最大）： 2.96W
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-TFBGA
供應(yīng)商設(shè)備封裝： 144-CTFBGA
包裝： 管件
輸入數(shù)目和類型： 16 個單端，單極；8 個差分，單極
Ultra-Low-Power, Octal, 12-Bit, 50Msps,
1.8V ADC with Serial LVDS Outputs
MAX19527
5
ELECTRICAL CHARACTERISTICS (continued)
(VAVDD = 1.8V, VOVDD = 1.8V, internal reference, AIN = -0.5dBFS, differential clock, VCLKD = 1.5VP-P, fCLK = 50MHz, programmable
registers at default settings (Table 1), TA = -40NC to +85NC, typical values are at TA = +25NC, unless otherwise noted.) (Note 1)
Note 1: Specifications are 100% production tested at TA R +25NC. Specifications for TA < +25NC are guaranteed by design and
characterization.
Note 2: Specifications guaranteed by design and characterization.
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
SERIAL PERIPHERAL INTERFACE (SPI) TIMING (Figure 9, Note 2)
SCLK Period
tSCLK
50
ns
SCLK to CS Setup Time
tCSS
10
ns
SCLK to CS Hold Time
tCSH
10
ns
SDIO to SCLK Setup Time
tSDS
Serial-data write
10
ns
SDIO to SCLK Hold Time
tSDH
Serial-data write
0
ns
SCLK to SDIO Output Data Delay
tSDD
Serial-data read
10
ns
TIMING CHARACTERISTICS (Figures 6 and 7, Note 2)
Data Valid to CLKOUT Rise/Fall
tOD
tSAMPLE/
24 - 0.10
tSAMPLE/
24 + 0.05
tSAMPLE/
24 + 0.20
ns
CLKOUT Output-Width High
tCH
tSAMPLE/12
ns
CLKOUT Output-Width Low
tCL
tSAMPLE/12
ns
FRAME Rise to CLKOUT Rise
tDF
tSAMPLE/
24 - 0.10
tSAMPLE/
24 + 0.05
tSAMPLE/
24 + 0.20
ns
Sample CLK Rise to Frame Rise
tSF
tSAMPLE/
2 + 1.6
tSAMPLE/
2 + 2.3
tSAMPLE/
2 + 3.3
ns
POWER REQUIREMENTS
Analog Supply Voltage
VAVDD
1.7
1.8
1.9
V
Digital Output Supply Voltage
VOVDD
1.7
1.8
1.9
V
Analog Supply Current
IAVDD
8 channels active
158
180
mA
Incremental channel power-down
-18
Nap mode
13
15
Sleep mode
0.35
0.5
Digital Output Supply Current
IOVDD
8 channels active, external RLOAD = 100I
87
mA
Incremental channel power-down
-7.4
Nap mode
28
Sleep mode
< 0.1
Total Power Dissipation
PTD
8 channels active
440
mW
Incremental channel power-down
-46
Nap mode
74
Sleep mode
0.8
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PDF描述
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