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參數(shù)資料
| 型號： | MB15F78SP |
| 廠商： | Fujitsu Limited |
| 英文描述： | Dual Serial Input PLL Frequency Synthesizer |
| 中文描述： | 雙串行輸入鎖相環(huán)頻率合成器 |
| 文件頁數(shù)： | 13/27頁 |
| 文件大?。?/td> | 296K |
| 代理商： | MB15F78SP |
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MB15F78SP
13
I
PHASE COMPARATOR OUTPUT WAVEFORM
fr
TX
/
fr
RX
fp
TX
/
fp
RX
LD
Do
TX
/
Do
RX
t
WU
t
WL
Do
TX
/
Do
RX
H
L
L
H
Z
Z
LD Output Logic Table
TX-PLL section
Note
s:
Phase error detection range = –2
π
to + 2
π
Pulses on Do
TX
/Do
RX
signals are output to prevent dead zone.
LD output becomes low when phase error is t
WU
or more.
LD output becomes high when phase error is t
WL
or less and continues to be so for three cycles or more.
t
WU
and t
WL
depend on OSC
IN
input frequency as follows.
t
WU
> 2/fosc: e.g. t
WU
> 156.3 ns when fosc = 12.8 MHz
t
WU
< 4/fosc: e.g. t
WL
< 312.5 ns when fosc = 12.8 MHz
RX-PLL section
LD output
Locking state/Power saving state
Locking state/Power saving state
H
Locking state/Power saving state
Unlocking state
L
Unlocking state
Locking state/Power saving state
L
Unlocking state
Unlocking state
L
(FC bit
=
High)
(FC bit
=
Low)
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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