參數(shù)資料
型號(hào)： MB81116422A-84
廠商： Fujitsu Limited
英文描述： CMOS 2×2M ×4 BIT Hyper Page Mode Dynamic RAM(CMOS 2×2M ×4 位超級(jí)頁(yè)面存取模式動(dòng)態(tài)RAM)
中文描述： 的CMOS 2 × 200萬(wàn)× 4位超頁(yè)模式動(dòng)態(tài)RAM（2 × 200萬(wàn)的CMOS × 4位超級(jí)頁(yè)面存取模式動(dòng)態(tài)內(nèi)存）
文件頁(yè)數(shù)： 38/43頁(yè)
文件大?。?/td> 275K
代理商： MB81116422A-84
38
MB81116422A-125/-100/-84/-67
TIMING DIAGRAM – 10 : WRITE INTERRUPTED BY PRECHARGE (Example @ CL = 3)
CLK
Command
DQ
Precharge
Active
Data-In
Masked
by PRE
Last
Data-In
Note:
The precharge command (PRE) should only be issued after the t
RWL
of final data input, is satisfied.
t
RWL
(min)
t
RP
(min)
TIMING DIAGRAM – 11 : READ INTERRUPTED BY WRITE (Example @ CL = 3, BL = 4)
CLK
Command
DQM
DQ
Data Out
Masked
Data In
Data In
Note 1
Note 2
I
DQZ
(2 clocks)
Note 3
Write
Notes:
1. First DQM makes high-impedance state High-Z between last output and first input data.
2. Second DQM makes internal output data mask to avoid bus contention.
3. Third DQM in illustrated above also makes internal output data mask. If burst read ends (final data output) at or after
the second clock of burst write, this third DQM is required to avoid internal bus contention.
Read
I
DWD
(same clock)
I
OWD
(2 clocks)
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PDF描述
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