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參數(shù)資料
| 型號(hào)： | MB90F568PMC |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁(yè)數(shù)： | 60/92頁(yè) |
| 文件大?。?/td> | 2097K |
| 代理商： | MB90F568PMC |
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MB90560/565 Series
DS07-13715-5E
63
(4) UART0, UART1, and I/O Expansion Serial Timings
(TA
= 40 °C to +85 °C, VCC = 5.0 V ±10%, VSS = AVSS = 0.0 V)
Notes :
These are the AC ratings for CLK synchronous mode.
CL is the load capacitor connected to the pin for testing.
tCP is the machine cycle period (unit = ns)
Parameter
Symbol
Pin Name
Condition
Value
Unit Remarks
Min.
Max.
Serial clock cycle time
tSCYC
SCK0, SCK1
Internal shift clock
mode, output pin load is
CL
= 80 pF + 1 TTL
8 tCP
ns
SCK
↓ → SOT delay
time
tSLOV
SCK0, SCK1
SOT0, SOT1
80
ns
Valid SIN
→ SCK ↑
tIVSH
SCK0, SCK1
SIN0, SIN1
100
ns
SCK
↑ → valid
SIN hold time
tSHIX
SCK0, SCK1
SIN0, SIN1
60
ns
Serial clock “H” pulse
width
tSHSL
SCK0, SCK1
External shift clock
mode, output pin load is
CL
= 80 pF + 1 TTL
4 tCP
ns
Serial clock “L” pulse
width
tSLSH
SCK0, SCK1
4 tCP
ns
SCK
↓ → SOT delay
time
tSLOV
SCK0, SCK1
SOT0, SOT1
150
ns
Valid SIN
→ SCK ↑
tIVSH
SCK0, SCK1
SIN0, SIN1
60
ns
SCK
↑ → valid
SIN hold time
tSHIX
SCK0, SCK1
SIN0, SIN1
60
ns
相關(guān)PDF資料 |
PDF描述 |
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