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參數(shù)資料
| 型號： | MB95F128DPMC-GE1 |
| 廠商： | Fujitsu Semiconductor America Inc |
| 文件頁數(shù)： | 22/67頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU FLASH 60K ROM 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | F²MC MB95120 |
| 核心處理器： | F²MC-8FX |
| 芯體尺寸： | 8-位 |
| 速度： | 16MHz |
| 連通性： | I²C，LIN，SIO，UART/USART |
| 外圍設(shè)備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 87 |
| 程序存儲器容量： | 60KB（60K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.3 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x8/10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
| 其它名稱： | 865-1072 |
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MB95120 Series
29
(Continued)
R/W access symbols
Initial value symbols
Note : Do not write to the “ (Disabled) ”. Reading the “ (Disabled) ” returns an undefined value.
Address
Register
abbreviation
Register name
R/W
Initial value
0FBFH
BRSR0
UART/SIO dedicated baud rate generator
baud rate setting register ch.0
R/W
00000000B
0FC0H,
0FC1H
(Disabled)
0FC2H
AIDRH
A/D input disable register (upper byte)
R/W
00000000B
0FC3H
AIDRL
A/D input disable register (lower byte)
R/W
00000000B
0FC4H
LCDCC
LCDC control register
R/W
00010000B
0FC5H
LCDCE1
LCDC enable register 1
R/W
00110000B
0FC6H
LCDCE2
LCDC enable register 2
R/W
00000000B
0FC7H
LCDCE3
LCDC enable register 3
R/W
00000000B
0FC8H
LCDCE4
LCDC enable register 4
R/W
00000000B
0FC9H
LCDCE5
LCDC enable register 5
R/W
00000000B
0FCAH
LCDCE6
LCDC enable register 6
R/W
00000000B
0FCBH
LCDCB1
LCDC blinking setting register 1
R/W
00000000B
0FCCH
LCDCB2
LCDC blinking setting register 2
R/W
00000000B
0FCDH
to
0FE0H
LCDRAM
LCDC display RAM
R/W
00000000B
0FE1H,
0FE2H
(Disabled)
0FE3H
WCDR
Watch counter data register
R/W
00111111B
0FE4H
to
0FEDH
(Disabled)
0FEEH
ILSR
Input level select register
R/W
00000000B
0FEFH
WICR
Interrupt pin select circuit control register
R/W
01000000B
0FF0H
to
0FFFH
(Disabled)
R/W
: Readable/Writable
R
: Read only
W
: Write only
0
: The initial value of this bit is “0”.
1
: The initial value of this bit is “1”.
X
: The initial value of this bit is undefined.
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