參數(shù)資料
型號： MB9AF131LPMC
廠商： FUJITSU LTD
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP64
封裝： 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, PLASTIC, LQFP-64
文件頁數(shù)： 47/80頁
文件大?。?/td> 762K
代理商： MB9AF131LPMC
51
FUJITSU SEMICONDUCTOR CONFIDENTIAL
r0.3
MB9A130L Series
DS706-00013-0v01-E
AC Characteristics
(1) Main Clock Input Characteristics
(Vcc = 1.8V to 5.5V, Vss = 0V, Ta = - 40
°C to + 85°C)
Value
Parameter
Symbol
Pin
name
Conditions
Min
Max
Unit
Remarks
-
4
20
MHz
When crystal oscillator
is connected
Vcc ≥ 4.5V
4
20
MHz
Input frequency
FCH
Vcc
< 4.5V
4
16
MHz
When using external
clock
Vcc ≥ 4.5V
50
250
ns
Input clock cycle
tCYLH
Vcc
< 4.5V
62.5
250
ns
When using external
clock
Input clock pulse
width
-
PWH/tCYLH
PWL/tCYLH
45
55
%
When using external
clock
Input clock rise
time and fall time
tCF
tCR
X0
X1
-
5
ns
When using external
clock
Vcc ≥ 2.0V
-
20
MHz
FCC
-
Vcc
< 2.0V
-
TBD
MHz
Base clock
(HCLK/FCLK)
Vcc ≥ 2.0V
-
20
MHz
FCP0
-
Vcc
< 2.0V
-
TBD
MHz
APB0 bus clock*2
Vcc ≥ 2.0V
-
20
MHz
FCP1
-
Vcc
< 2.0V
-
TBD
MHz
APB1 bus clock*2
Vcc ≥ 2.0V
-
20
MHz
Internal operating
clock*1
frequency
FCP2
-
Vcc
< 2.0V
-
TBD
MHz
APB2 bus clock*2
Vcc ≥ 2.0V
50
-
ns
tCYCC
-
Vcc
< 2.0V
TBD
-
ns
Base clock
(HCLK/FCLK)
Vcc ≥ 2.0V
50
-
ns
tCYCP0
-
Vcc
< 2.0V
TBD
-
ns
APB0 bus clock*2
Vcc ≥ 2.0V
50
-
ns
tCYCP1
-
Vcc
< 2.0V
TBD
-
ns
APB1 bus clock*2
Vcc ≥ 2.0V
50
-
ns
Internal operating
clock*1
cycle time
tCYCP2
-
Vcc
< 2.0V
TBD
-
ns
APB2 bus clock*2
*1: For more information about each internal operating clock, see chapter "Chapter: Clock" in "FM3 FAMILY
MB9Axxx/MB9Bxxx Series PERIPHERAL MANUAL".
*2: For about each APB bus which each peripheral is connected to, see chapter "BLOCK DIAGRAM" in
this data sheet.
0.8×Vcc
tCYLH
X0
PWH
0.2×Vcc
tCF
PWL
tCR
0.2×Vcc
·
Guaranteed operation range
Po
w
er
su
p
pl
y
vol
tage
Vc
c(
V)
TBD
20
Internal operating clock frequency Fcc(MHz)
5.5
1.8
2.0
0
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PDF描述
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