參數(shù)資料
型號： MB9AF131LPMC
廠商： FUJITSU LTD
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, RISC MICROCONTROLLER, PQFP64
封裝： 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, LEAD FREE, PLASTIC, LQFP-64
文件頁數(shù)： 59/80頁
文件大?。?/td> 762K
代理商： MB9AF131LPMC
62
FUJITSU SEMICONDUCTOR CONFIDENTIAL
r0.3
MB9A130L Series
DS706-00013-0v01-E
·
Synchronous serial (SPI = 1, SCINV = 1)
(Vcc = 1.8V to 5.5V, Vss = 0V, Ta = - 40
°C to + 85°C)
Vcc
< 2.7V
2.7V ≤
Vcc
< 4.5V
Vcc ≥ 4.5V
Parameter
Symbol
Pin
name
Conditions
Min
Max
Min
Max
Min
Max
Unit
Serial clock
cycle time
tSCYC
SCKx
4tcycp
-
4tcycp
-
4tcycp
-
ns
SCK
↓ → SOT
delay time
tSLOVI
SCKx
SOTx
-30
+30
-30
+30
-20
+20
ns
SIN
→ SCK ↑
setup time
tIVSHI
SCKx
SINx
75
-
50
-
30
-
ns
SCK
↑ → SIN
hold time
tSHIXI
SCKx
SINx
0
-
0
-
0
-
ns
SOT
→ SCK ↑
delay time
tSOVHI
SCKx
SOTx
Internal shift
clock
operation
2tcycp -
30
-
2tcycp -
30
-
2tcycp
- 30
-
ns
Serial clock "L"
pulse width
tSLSH
SCKx
2tcycp -
10
-
2tcycp -
10
-
2tcycp
- 10
-
ns
Serial clock "H"
pulse width
tSHSL
SCKx
tcycp +
10
-
tcycp +
10
-
tcycp +
10
-
ns
SCK
↓ → SOT
delay time
tSLOVE
SCKx
SOTx
-
75
-
50
-
30
ns
SIN
→ SCK ↑
setup time
tIVSHE
SCKx
SINx
10
-
10
-
10
-
ns
SCK
↑ → SIN
hold time
tSHIXE
SCKx
SINx
20
-
20
-
20
-
ns
SCK fall time
tF
SCKx
-
5
-
5
-
5
ns
SCK rise time
tR
SCKx
External shift
clock
operation
-
5
-
5
-
5
ns
Notes:
·
The above characteristics apply to CLK synchronous mode.
·
tCYCP indicates the APB bus clock cycle time.
About the APB bus number which UART is connected to, see chapter "BLOCK DIAGRAM"
in this data sheet.
·
These characteristics only guarantee the same relocate port number.
For example, the combination of SCLKx_0 and SOTx_1 is not guaranteed.
·
When the external load capacitance CL = 50pF.
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