參數(shù)資料
型號： MB9BF416TBGL
廠商： FUJITSU LTD
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, RISC MICROCONTROLLER, PBGA192
封裝： 12 X 12 MM, 1.45 MM HEIGHT, 0.80 MM PITCH, LEAD FREE, PLASTIC, FBGA-192
文件頁數(shù)： 109/116頁
文件大?。?/td> 1064K
代理商： MB9BF416TBGL
92
MB9B410T Series
FUJITSU SEMICONDUCTOR CONFIDENTIAL
r1.0
DS706-00018-0v01-E
(9) UART Timing
Synchronous serial (SPI = 0, SCINV = 0)
(Vcc = 2.7V to 5.5V, Vss = 0V, Ta = - 40
°C to + 85°C)
Vcc
< 4.5V
Vcc
≥ 4.5V
Parameter
Symbol
Pin
name
Conditions
Min
Max
Min
Max
Unit
Serial clock cycle time
tSCYC SCKx
4tcycp
-
4tcycp
-
ns
SCK
↓ → SOT delay time
tSLOVI
SCKx
SOTx
-30
+30
- 20
+ 20
ns
SIN
→ SCK ↑ setup time
tIVSHI
SCKx
SINx
50
-
30
-
ns
SCK
↑ → SIN hold time
tSHIXI
SCKx
SINx
Internal shift
clock
operation
0
-
0
-
ns
Serial clock "L" pulse width
tSLSH SCKx
2tcycp -
10
-
2tcycp
- 10
-
ns
Serial clock "H" pulse width
tSHSL SCKx
tcycp +
10
-
tcycp +
10
-
ns
SCK
↓ → SOT delay time
tSLOVE
SCKx
SOTx
-
50
-
30
ns
SIN
→ SCK ↑ setup time
tIVSHE
SCKx
SINx
10
-
10
-
ns
SCK
↑ → SIN hold time
tSHIXE
SCKx
SINx
20
-
20
-
ns
SCK fall time
tF
SCKx
-
5
-
5
ns
SCK rise time
tR
SCKx
External shift
clock
operation
-
5
-
5
ns
Notes:
The above characteristics apply to CLK synchronous mode.
tCYCP indicates the APB bus clock cycle time.
About the APB bus number which UART is connected to, see chapter " BLOCK DIAGRAM" in this
data sheet.
These characteristics only guarantee the same relocate port number.
For example, the combination of SCLKx_0 and SOTx_1 is not guaranteed.
When the external load capacitance = 30pF.
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PDF描述
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