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參數(shù)資料
| 型號： | MBM29LV160TE12PBT |
| 廠商： | FUJITSU LTD |
| 元件分類： | DRAM |
| 英文描述： | 16M (2M X 8/1M X 16) BIT |
| 中文描述： | 2M X 8 FLASH 3V PROM, 120 ns, PBGA48 |
| 封裝： | PLASTIC, FBGA-48 |
| 文件頁數(shù)： | 36/59頁 |
| 文件大?。?/td> | 653K |
| 代理商： | MBM29LV160TE12PBT |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁當(dāng)前第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁
MBM29LV160TE/BE
-70/90/12
36
t
CH
t
CS
t
WP
t
WHWH1
t
WC
CE
OE
t
RC
Addresses
Data
t
GHWL
t
CE
t
OE
t
WPH
t
DS
t
DH
DQ
7
PD
A0H
D
OUT
D
OUT
WE
555H
PA
PA
t
OH
t
DF
Data Polling
3rd Bus Cycle
t
AS
t
AH
Notes: 1. PA is address of the memory location to be programmed.
2. PD is data to be programmed at word address.
3. DQ
7
is the output of the complement of the data written to the device.
4. D
OUT
is the output of the data written to the device.
5. Figure indicates last two bus cycles out of four bus cycle sequence.
6. These waveforms are for the
×
16 mode. (The addresses differ from
×
8 mode.)
Figure 6 Alternate WE Controlled Program Operation Timing Diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MBM29LV160TE-90 | 16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE12TN | 16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE12TR | 16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE70PBT | 16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE70TN | 16M (2M X 8/1M X 16) BIT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MBM29LV160TE12PCV | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE12TN | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE12TR | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE-70 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16M (2M X 8/1M X 16) BIT |
| MBM29LV160TE70PBT | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16M (2M X 8/1M X 16) BIT |
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