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參數(shù)資料
| 型號： | MC14501BCP |
| 廠商： | MOTOROLA INC |
| 元件分類： | 標準邏輯 |
| 英文描述： | Dual 4-Input NAND Gate, 2-Input NOR/OR Gate, 8-Input AND/NAND Gate |
| 中文描述： | SPECIALTY LOGIC CIRCUIT, PDIP16 |
| 封裝： | PLASTIC, DIP-16 |
| 文件頁數(shù)： | 3/6頁 |
| 文件大?。?/td> | 219K |
| 代理商： | MC14501BCP |
MOTOROLA CMOS LOGIC DATA
3
MC14501UB
tTLH = (3.0 ns/pF) CL + 30 ns
tTLH = (1.5 ns/pF) CL + 15 ns
tTHL = (1.5 ns/pF) CL + 25 ns
tTLH = (1.35 ns/pF) CL + 32.5 ns
tTHL = (0.67 ns/pF) CL + 26.5 ns
tPLH, tPHL = (1.7 ns/pF) CL + 45 ns
5.0
10
180
90
360
180
5.0
5.0
100
100
200
200
5.0
60
120
tPHL
50
15
130
50
260
100
tPLH, tPHL = (0.66 ns/pF) CL + 32 ns
tPHL
10
65
130
tPLH, tPHL = (0.5 ns/pF) CL + 25 ns
15
50
100
* The formulas given are for the typical characteristics only at 25 C.
This device contains protection circuitry to guard against damage due to high static voltages or electric fields. However,
precautions must be taken to avoid applications of any voltage higher than maximum rated voltages to this high-impedance
circuit. For proper operation, Vin and Vout should be constrained to the range VSS
≤
(Vin or Vout)
≤
VDD.
Unused inputs must always be tied to an appropriate logic voltage level (e.g., either VSS or VDD). Unused outputs must
be left open.
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