參數(shù)資料
型號： MC14527BCL
廠商： MOTOROLA INC
元件分類： 通用總線功能
英文描述： BCD Rate Multiplier
中文描述： 4000/14000/40000 SERIES, SYN NEGATIVE EDGE TRIGGERED 4-BIT UP DECADE COUNTER, CDIP16
封裝： CERAMIC, DIP-16
文件頁數(shù)： 6/8頁
文件大小： 246K
代理商： MC14527BCL
MOTOROLA CMOS LOGIC DATA
MC14527B
6
Figure 4. Two MC14527Bs in Cascade with Preset No. of 94
CASC
Ein
ST
CLEAR
CLOCK
A
B
C
D
Eout
OUT
“9”
S
CLOCK
CASC
Ein
ST
CLEAR
CLOCK
A
B
C
D
Eout
OUT
“9”
S
CLOCK
0
0
0
1
1
2
2
3
3
4
4
5
5
6
6
7
7
8
8
9
9
1
0
0
1
1
0
0
0
OUT
DRM
One of four output pulses contributed by DRM
to
output for every 100 clock pulses in for preset No. of 94.
NOTE: More than two MC14527Bs
may be cascaded using this
configuration.
MOST SIGNIFICANT
DIGIT
LEAST SIGNIFICANT
DIGIT
2
2
2
1
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PDF描述
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