參數(shù)資料
型號： MC14568BD
廠商： MOTOROLA INC
元件分類： 通用總線功能
英文描述： Phase Comparator and Programmable Counters
中文描述： 4000/14000/40000 SERIES, ASYN POSITIVE EDGE TRIGGERED UP DIVIDE BY N COUNTER, PDSO16
封裝： PLASTIC, SOIC-16
文件頁數(shù)： 9/12頁
文件大?。?/td> 323K
代理商： MC14568BD
MOTOROLA CMOS LOGIC DATA
9
MC14568B
Figure 8. Frequency Synthesizer Using MC14568B, MC14569B and MC14522B
(Without Mixer)
Divide ratio = 160N1 + 16N2 + N3
Example:
fout = N1 (MHz) + N2 (x 100 kHz) + N3 (x25 kHz)
Frequency range = 5 MHz
Channel spacing = 25 kHz
Reference frequency = 6.25 kHz
Figures shown in parenthesis refer to example.
Recommended reading:
(1) AN535: “Phase–Lock Techniques”
(2) AR254: “Phase–Locked Loop Design Articles”
(5 MHz)
(VDD)
VDD
VDD
PCin
C1
CTL
“0”
MC14568B
PCout
G
F
PE
VSS
VDD
DP0 – – – – – DP3
VCO
fout
DP0 – – – – – DP3
C
PE
MC14522B
“0”
Q
ZERO DETECT
(BCD)
BINARY
CF
C
N1
(0 – 5)
(625 kHz STEPS)
N2
(0 – 9)
(62.5 kHz STEPS)
N3
(0, 4, 8, 12)
(6.25 kHz STEPS)
MC14569B
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